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asic ip核文章進(jìn)入asic ip核技術(shù)社區(qū)

基于快速傅里葉IP核的數(shù)字脈壓處理器的實(shí)現(xiàn)

引言

脈沖壓縮體制在現(xiàn)代雷達(dá)中被廣泛采用，通過(guò)發(fā)射寬脈沖來(lái)提高發(fā)射的平均功率，保證足夠的作用距離；接收時(shí)則采用相應(yīng)的脈沖壓縮算法獲得脈寬較窄的脈沖，以提高距離分辨力，從而能夠很好地解決作用距離和距離
關(guān)鍵字：快速傅里葉 IP核處理器數(shù)字

AES加密算法的高速低功耗ASIC設(shè)計(jì)

摘要：本文提出了一個(gè)AES加密算法的高速低功耗ASIC設(shè)計(jì)方案，使用Synopsys設(shè)計(jì)流程和VeriSilicON 0.18mu;m CMOS工藝，實(shí)現(xiàn)了最高工作頻率410MHz，數(shù)據(jù)吞吐率5.23Gbps，功耗為58 mW。采用改進(jìn)算法(T盒算法)，將輪變
關(guān)鍵字： ASIC AES 加密算法低功耗

淺談FPGA與ASIC的設(shè)計(jì)優(yōu)勢(shì)

ASIC 和 FPGA 具有不同的價(jià)值主張，選擇其中之一之前，一定要對(duì)其進(jìn)行仔細(xì)評(píng)估。2種技術(shù)的比較信息非常豐富。這里介紹了ASIC和FPGA的優(yōu)勢(shì)與劣勢(shì)。FPGA 和 ASIC 的設(shè)計(jì)優(yōu)勢(shì)比較FPGA 的設(shè)計(jì)優(yōu)勢(shì)更快的面市時(shí)間 - 無(wú)需布
關(guān)鍵字： FPGA ASIC

JPEG編碼器IP核性能優(yōu)化解決方案

6月19日，半導(dǎo)體IP供應(yīng)商CAST公司宣布對(duì)其提供的JPEG編碼器IP核進(jìn)行功能及性能優(yōu)化?！　∠到y(tǒng)設(shè)計(jì)師現(xiàn)在有兩 ...
關(guān)鍵字： JPEG 編碼器 IP核性能優(yōu)化

FPGA和ASIC的比較

ASIC是英文的Application Specific Integrated Circuits縮寫(xiě)，即專(zhuān)用集成電路，是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。目前用CPLD(復(fù)雜可編程邏輯器件)和FPGA(現(xiàn)場(chǎng)可編程邏輯陣列)來(lái)進(jìn)行AS
關(guān)鍵字： FPGA ASIC 比較

SoC中的處理單元性能評(píng)估及功能劃分

電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
關(guān)鍵字： DSP ASIC RISC FPGA SoC

基于Avalon總線接口的UPFC控制器IP核設(shè)計(jì)

0引言統(tǒng)一潮流控制器(UnifiedPowerFlowCon-troller，簡(jiǎn)稱(chēng)UPFC)是一種可以較大范圍地控制電流使之按指定路...
關(guān)鍵字： Avalon總線 UPFC控制器 IP核

泰克元件解決方案公司與MOSIS簽訂ASIC服務(wù)協(xié)議

定制微電子服務(wù)提供商---泰克元件解決方案公司(Tektronix Component Solutions)日前宣布，與領(lǐng)先的供應(yīng)鏈集成商(aggregator)-- MOSIS公司就幫助客戶開(kāi)發(fā)完整的高性能ASIC解決方案，同時(shí)降低早期ASIC開(kāi)發(fā)成本達(dá)成協(xié)議。
關(guān)鍵字：泰克 MOSIS ASIC

FPGA和ASIC的電源管理方案

目前的電子產(chǎn)品市場(chǎng)競(jìng)爭(zhēng)非常激烈，廠商都希望能在最短時(shí)間內(nèi)將新產(chǎn)品推出市場(chǎng)，以致子系統(tǒng)的設(shè)計(jì)周期越縮越...
關(guān)鍵字： FPGA ASIC 電源管理

基于BIST的IP核測(cè)試方案設(shè)計(jì)

1 引言　　隨著半導(dǎo)體工藝的發(fā)展，片上系統(tǒng)SOC已成為當(dāng)今一種主流技術(shù)。基于IP復(fù)用的SOC設(shè)計(jì)是通過(guò)用戶自定義邏輯(UDL)和連線將IP核整合為一個(gè)系統(tǒng)，提高了設(shè)計(jì)效率，加快了設(shè)計(jì)過(guò)程，縮短了產(chǎn)品上市時(shí)間。但是隨著設(shè)
關(guān)鍵字： BIST IP核測(cè)試方案設(shè)計(jì)

ASIC和微處理器芯片供電電源電路介紹

今天的高性能ASIC和微處理器芯片消耗的功率可超過(guò)150瓦。對(duì)于1 V1.5 V的供電電壓，這些器件所需要的電流可輕易超過(guò)100 A。通過(guò)采用多相直流/直流轉(zhuǎn)換器，為此類(lèi)器件供電的任務(wù)可變得更容易處理。目前，可擴(kuò)展控制器
關(guān)鍵字：電路介紹電源供電微處理器芯片 ASIC

富士通半導(dǎo)體交付55nm創(chuàng)新方案

　　解本土IC設(shè)計(jì)之“渴” 　　近來(lái)中國(guó)IC市場(chǎng)的最重磅新聞要屬大小“M”——臺(tái)灣聯(lián)發(fā)科(MTK)和晨星半導(dǎo)體(MStar)宣布合并。“M兄弟”的聯(lián)手對(duì)已跨入“1億美元俱樂(lè)部”的少數(shù)剛崛起的大陸本土IC設(shè)計(jì)公司帶來(lái)很大的競(jìng)爭(zhēng)壓力，而原本就缺資金、缺平臺(tái)、缺資源的本土小型和微型IC廠商的生存空間更加令人堪憂。　　正如富士通半導(dǎo)體ASIC/COT業(yè)務(wù)市場(chǎng)部副經(jīng)理劉哲女士在不久前閉幕的&
關(guān)鍵字： IC 富士通半導(dǎo)體 ASIC/COT

ASIC和微處理器芯片供電電源介紹及應(yīng)用實(shí)例

今天的高性能ASIC和微處理器芯片消耗的功率可超過(guò)150瓦。對(duì)于1 V1.5 V的供電電壓，這些器件所需要的電流可輕易超過(guò)100 A。通過(guò)采用多相直流/直流轉(zhuǎn)換器，為此類(lèi)器件供電的任務(wù)可變得更容易處理。目前，可擴(kuò)展控制器
關(guān)鍵字：介紹應(yīng)用實(shí)例電源供電微處理器芯片 ASIC

ISOFACE提供智能化保護(hù)

摘要：ISOFACE產(chǎn)品家族能以智能化方式解決大多數(shù)工業(yè)自動(dòng)化系統(tǒng)所面臨的共同挑戰(zhàn)，譬如，可編程邏輯控制器(PLC)、驅(qū)動(dòng)器、工業(yè)PC、機(jī)器人系統(tǒng)、分布式控制系統(tǒng)、樓宇控制系統(tǒng)、普通控制設(shè)備和傳感器輸入模組。
關(guān)鍵字：工業(yè)自動(dòng)化 ISOFACE ASIC 201206

基于FPGA的DDS IP核設(shè)計(jì)

摘要：以Altera公司的QuartusⅡ7．2作為開(kāi)發(fā)工具，研究了基于FPGA的DDS IP核設(shè)計(jì)，并給出基于Signal TapⅡ嵌入式邏輯分析儀的仿真測(cè)試結(jié)果。將設(shè)計(jì)的DDS IP核封裝成為SOPC Builder自定義的組件，結(jié)合32位嵌入式CPU軟
關(guān)鍵字： FPGA DDS IP核

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asic ip核介紹

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asic ip核電路

結(jié)合FPGA與結(jié)構(gòu)化ASIC進(jìn)行設(shè)計(jì)
ENP重定義以太轉(zhuǎn)發(fā)技術(shù)
FPGA并行計(jì)算抽象接口的設(shè)計(jì)與實(shí)現(xiàn)
CPLD對(duì)FPGA從并快速加載的解決方案

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釋說(shuō)芯語(yǔ)27：你可能學(xué)了假的數(shù)字集成電路：從FPGA和ASIC設(shè)計(jì)的差別開(kāi)說(shuō)
華為-海思部門(mén)與展訊CPU部門(mén)，選哪個(gè)？求建議。。

asic ip核資料下載

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高級(jí)ASIC芯片綜合
由于具備大規(guī)模生產(chǎn)能力、低成本工具和越來(lái)越低的掩膜價(jià)格，當(dāng)前的專(zhuān)用 ASIC 設(shè)計(jì)極具成本優(yōu)勢(shì)
考慮單粒子效應(yīng)對(duì) FPGA、ASIC 和處理器的影響
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