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基于JTAG邊界掃描方式的重構(gòu)控制器的設(shè)計

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作者：方超龔龍慶張寶利西安微電子技術(shù)研究所時間：2010-02-05 來源：電子產(chǎn)品世界

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　　系統(tǒng)仿真

本文引用地址：http://www.antipu.com.cn/article/105941.htm

　　仿真在Active-HDL7.1軟件下運行，所有仿真是基于對單器件配置的過程。

　　圖4為JTAG邊界掃描方式核心控制TAP狀態(tài)機仿真波形，本文把整個下載模擬過程設(shè)計為三步，分別為TAP_Reset、TAP_CFG、TAP_JStart，ARM分別給三步提供一個啟動命令，三個步驟分時按順序由自己獨立的狀態(tài)機實現(xiàn)，由圖可以看出狀態(tài)銜接正確。

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關(guān)鍵詞： FPGA TAP狀態(tài)機 JTAG邊界掃描 重構(gòu) 201001

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