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ChipDesign ISE 11 設(shè)計工具視點
- 作為一個負責FPGA 企業(yè)市場營銷團隊工作的人，我不得不說，由于在工藝技術(shù)方面的顯著成就以及硅芯片設(shè)計領(lǐng)域的獨創(chuàng)性，F(xiàn)PGA 正不斷實現(xiàn)其支持片上系統(tǒng)設(shè)計的承諾。隨著每一代新產(chǎn)品的推出，F(xiàn)PGA 在系統(tǒng)中具有越來來越多的功能，可作為協(xié)處理器、DSP 引擎以及通信平臺等，在某些應(yīng)用領(lǐng)域甚至還可用作完整的片上系統(tǒng)。 因此，在摩爾定律的作用下，F(xiàn)PGA 產(chǎn)業(yè)的門數(shù)量不斷增加，性能與專門功能逐漸加強，使得 FPGA 在電子系統(tǒng)領(lǐng)域能夠取代此前只有 ASIC 和 ASSP 才能發(fā)揮的作用。不過，說到底，F(xiàn)
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泰科電子推出Multi-Beam XLE連接器
- 全球全球領(lǐng)先的電子組件供應(yīng)商泰科電子近日宣布推出全新MULTI-BEAM XLE連接器產(chǎn)品。作為泰科電子備受市場認可的MULTI-BEAM XL配電連接器的增強版，新產(chǎn)品的負載電流較標準型MULTI-BEAM XL配電連接器提升20%以上，而耐用度更是其他同類產(chǎn)品的兩倍之多。原有MULTI-BEAM XL產(chǎn)品負載電流為35安培，而新型連接器的每個觸點可負載高達50安培的電流。MULTI-BEAM XLE的觸點設(shè)計采用直角型垂直PCB插頭，以及線纜基座式插頭。此外，此款新型連接器還可提供20安培&ldq
- 關(guān)鍵字： 泰科 連接器 MULTI-BEAM XL
首屆中國開源IP核標準化設(shè)計競賽啟動
- 在工信部電子信息司的指導下，工業(yè)和信息化部軟件與集成電路促進中心(CSIP )聯(lián)合集成電路IP核標準工作組，現(xiàn)面向全國集成電路設(shè)計企業(yè)工程師、科研院所及高校師生，舉辦2009年“首屆中國開源IP核標準化設(shè)計競賽”，競賽報名工作已于6月3日啟動。報名及詳情咨詢可登錄競賽官方網(wǎng)站 http://www.ipmall.org.cn了解。據(jù)悉本次競賽獲獎?wù)呖煞謩e獲得現(xiàn)金1萬元、5千元等獎勵，針對學生參賽者有機會獲得到IBM中國芯片設(shè)計中心實習的機會! 參賽者可以個人或團隊(不高于
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基于Verilog計算精度可調(diào)的整數(shù)除法器的設(shè)計
- 0 引 言
除法器是電子技術(shù)領(lǐng)域的基礎(chǔ)模塊，在電子電路設(shè)計中得到廣泛應(yīng)用。目前，實現(xiàn)除法器的方法有硬件實現(xiàn)和軟件實現(xiàn)兩種方法。硬件實現(xiàn)的方法主要是以硬件的消耗為代價，從而有實現(xiàn)速度快的特點。用硬件的方 - 關(guān)鍵字： Verilog 計算 精度可調(diào) 整數(shù)除法器
基于神經(jīng)網(wǎng)絡(luò)電機 速度控制器的SOPC系統(tǒng)
- 針對機器人伺服控制系統(tǒng)高速度、高精度的要求，介紹一種全數(shù)字化的基于神經(jīng)網(wǎng)絡(luò)控制的直流電機速度伺服控制系統(tǒng)的設(shè)計方案。速度控制器采用BP網(wǎng)絡(luò)參數(shù)辨識自適應(yīng)控制，并將其在FPGA進行硬件實現(xiàn)；同時用Nios II軟核處理器作為上位機，構(gòu)成一個完整的速度伺服控制器的片上可編程系統(tǒng)(SOPC)。實驗結(jié)果表明，該控制系統(tǒng)具有較高的控制精度、較好的穩(wěn)定性和靈活性。
- 關(guān)鍵字： SOPC 系統(tǒng) 控制器 速度 神經(jīng)網(wǎng)絡(luò) 電機 基于 神經(jīng)網(wǎng)絡(luò) 伺服控制 現(xiàn)場可編程門陣列 Verilog HDL
基于Verilog的順序狀態(tài)邏輯FSM設(shè)計與仿真
- 硬件描述語言Verilog為數(shù)字系統(tǒng)設(shè)計人員提供了一種在廣泛抽象層次上描述數(shù)字系統(tǒng)的方式，同時，為計算機輔助設(shè)...
- 關(guān)鍵字： 狀態(tài)寄存器 設(shè)計與仿真 Verilog 邏輯綜合 FSM 綜合庫 設(shè)計要求 時鐘周期 層次化結(jié)構(gòu) 狀態(tài)機
基于Verilog-HDL的軸承振動噪聲電壓峰值檢測
- 引言 在軸承生產(chǎn)行業(yè)中，軸承振動噪聲的峰值檢測是一項重要的指標。以往，該檢測都是采用傳統(tǒng)的模擬電路方法，很難做到1：1地捕捉和保持較窄的隨機波形的最大正峰值。本文敘述了基于Verilog-HDL與高速A/D轉(zhuǎn)換器相結(jié)合所實現(xiàn)的快速軸承噪聲檢測方法。 1 振動噪聲電壓峰值檢測方案的確定 1.1 軸承振動噪聲的產(chǎn)生及檢測 圖1是軸承振動噪聲電壓峰值檢測系統(tǒng)的示意圖。由于加工設(shè)備、技術(shù)、環(huán)境等因素的影響，生產(chǎn)的軸承都程度不同地帶有傷疤。圖1中，假設(shè)某待測軸承有一處傷疤。由于傷痕的存在，軸
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