cadence 文章 進(jìn)入cadence技術(shù)社區(qū)
Cadence落戶南京市浦口區(qū),成為繼引進(jìn)臺積電后的又一龍頭項(xiàng)目
- 11月13日，電子設(shè)計自動化(EDA)與半導(dǎo)體知識產(chǎn)權(quán)(IP)的領(lǐng)先供應(yīng)商美國楷登電子(Cadence)與南京市浦口區(qū)人民政府正式簽署戰(zhàn)略合作備忘錄以及投資協(xié)議。據(jù)悉，Cadence 項(xiàng)目是南京市浦口區(qū)繼引進(jìn)臺積電之后在集成電路設(shè)計領(lǐng)域引進(jìn)的又一個龍頭性項(xiàng)目，歷經(jīng)兩年的洽談，在多方的共同努力下，今天終于簽約落地。 南京市江北新區(qū)管委會常務(wù)副主任、浦口區(qū)區(qū)委書記瞿為民先生致辭表示，此次簽約儀式標(biāo)志著南京市浦口區(qū)與 Cadence 雙方的戰(zhàn)略投資進(jìn)入實(shí)質(zhì)性階段。南京江北新區(qū)是江蘇省唯一的國家級新區(qū)，
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Cadence攜手Arm交付首個基于低功耗、高性能Arm服務(wù)器的SoC驗(yàn)證解決方案
- 楷登電子(美國Cadence 公司)今日與Arm聯(lián)合發(fā)布基于Arm? 服務(wù)器的Xcelium? 并行邏輯仿真平臺，這是電子行業(yè)內(nèi)首個低功耗高性能的仿真解決方案?！ ≡谛酒圃熘?， SoC芯片功能正確性驗(yàn)證占用了整個項(xiàng)目70%的EDA軟件使用資源，這一需求促進(jìn)了數(shù)據(jù)中心的增長。運(yùn)行于ARM服務(wù)器的Xcelium仿真可帶來功耗顯著降低和仿真容量的顯著提升，可執(zhí)行高吞吐和長周期測試，縮減了整個SoC驗(yàn)證的時間和成本?！ ∽鳛镃adence驗(yàn)證套件(Cadence&n
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Cadence優(yōu)化全流程數(shù)字與簽核及驗(yàn)證套裝，支持Arm Cortex-A75、Cortex-A55 CPU及Arm Mali-G72 GPU
- 楷登電子(美國Cadence公司)今日宣布，其全流程數(shù)字簽核工具和Cadence? 驗(yàn)證套裝的優(yōu)化工作已經(jīng)發(fā)布，支持最新Arm? Cortex?-A75和Cortex-A55 CP，基于Arm DynamIQ?技術(shù)的設(shè)計，及Arm Mali?-G72 GPU，可廣泛用于最新一代的高端移動應(yīng)用、機(jī)器學(xué)習(xí)及消費(fèi)電子類芯片。為加速針對Arm最新處理器的設(shè)計，Cadence為Cortex-A75和Cortex-A55 CPU量身開發(fā)全新7n
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千人盛會開幕，2017 Cadence全球用戶大會 CDNLive登陸上海
- 楷登電子(美國Cadence公司)宣布即將于8月22日(星期二)在上海浦東嘉里大酒店舉辦一年一度的中國用戶大會——CDNLive China 2017。以“聯(lián)結(jié)，分享，啟發(fā)!”為主題的CDNLive大會將集聚超過1000位IC行業(yè)從業(yè)者，包括IC設(shè)計工程師、系統(tǒng)開發(fā)者與業(yè)界專家，將分享重要半導(dǎo)體設(shè)計領(lǐng)域的解決方案和成功經(jīng)驗(yàn)，讓參與者獲得知識、靈感與動力，并為實(shí)現(xiàn)高階半導(dǎo)體芯片、SoC設(shè)計和系統(tǒng)挑戰(zhàn)提供解決方案。詳細(xì)的會議信息及報名請瀏覽www.cdnlive.com CDNLiv
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【E問E答】設(shè)計自己專用處理器該怎么完成？
- 做芯片設(shè)計的各位,在某個時刻,你也許會產(chǎn)生一個想法,“為什么不自己設(shè)計一個處理器呢?”或許是手頭的處理器并不好用;或許是想用的處理器貴的離譜;或許是你希望做出差異化的產(chǎn)品;又或者僅僅因?yàn)樗莻€誘人的挑戰(zhàn),你想嘗試一下...既然如此,我很高興能和你討論一下怎么完成這個任務(wù)?！ 〗桓段铩 ∥覀兿葟慕Y(jié)果說起,也就是這項(xiàng)任務(wù)的最終交付物。這里不妨參考ARM處理器核的deliverables。當(dāng)然,如果只是一個自己用的專用處理器,不一定要有這么完整的交付物?！ ∮布?主要是處理器相關(guān)的RTL代碼,驗(yàn)證環(huán)境,ED
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Cadence針對Palladium Z1仿真平臺發(fā)布VirtualBridge適配器，軟件初啟時間最高可縮短三個月
- 楷登電子(美國Cadence公司)今日正式發(fā)布全新VirtualBridge?適配器。較傳統(tǒng)RTL仿真，基于虛擬仿真技術(shù)的VirtualBridge?適配器可以加速硅前驗(yàn)證階段的軟件初啟。同時，VirtualBridge適配器與傳統(tǒng)在線(In-Circuit)仿真應(yīng)用模式互為補(bǔ)充，通過Cadence? Palladium? Z1企業(yè)級仿真平臺，可以讓軟件設(shè)計師提前3個月開始進(jìn)行硅前軟件驗(yàn)證工作。如需了解更多內(nèi)容，請?jiān)L問www.cadence.com/go/virtualbridge
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全新Cadence Virtuoso系統(tǒng)設(shè)計平臺幫助實(shí)現(xiàn)IC、封裝和電路板無縫集成的設(shè)計流程
- 楷登電子(美國Cadence公司)今日發(fā)布全新Cadence? Virtuoso? System Design Platform(Virtuoso系統(tǒng)設(shè)計平臺)，結(jié)合Cadence Virtuoso平臺與Allegro? 及Sigrity?技術(shù)，打造一個正式的、優(yōu)化的自動協(xié)同設(shè)計與驗(yàn)證流程。多項(xiàng)跨平臺技術(shù)的高度集成幫助設(shè)計工程師實(shí)現(xiàn)芯片、封裝和電路板的同步和協(xié)同設(shè)計。這一過程在此之前只能通過手動完成，全新Virtuoso系統(tǒng)設(shè)計平臺可以實(shí)現(xiàn)流
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Cadence擴(kuò)展JasperGold平臺用于高級形式化RTL簽核
- 楷登電子(美國Cadence公司)今日正式發(fā)布JasperGold? 形式驗(yàn)證平臺擴(kuò)展版，引入高級形式化驗(yàn)證技術(shù)的JasperGold Superlint和Clock Domain Crossing (CDC)應(yīng)用，以滿足JasperGold形式驗(yàn)證技術(shù)在RTL設(shè)計領(lǐng)域的簽核要求。較現(xiàn)有驗(yàn)證解決方案，Superlint和CDC應(yīng)用提高了IP設(shè)計質(zhì)量，后期RTL變更最高減少80%， IP開發(fā)時間縮短4周。如需了解更多關(guān)于JasperGold技術(shù)
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Cadence數(shù)字、簽核與定制/模擬工具助力實(shí)現(xiàn)三星7LPP和8LPP工藝技術(shù)
- 楷登電子(美國 Cadence 公司) 今日宣布其數(shù)字、簽核與定制/模擬工具成功在三星電子公司7LPP和8LPP工藝技術(shù)上實(shí)現(xiàn)。較前代高階工藝節(jié)點(diǎn)FinFET技術(shù)，7LPP和8LPP工藝技術(shù)不僅進(jìn)一步優(yōu)化了功耗、性能和面積特性，擴(kuò)展能力也更為出色。目前，客戶已經(jīng)可以應(yīng)用下一代技術(shù)開始早期設(shè)計?！ adence定制/模擬、數(shù)字和簽核工具全面滿足三星工藝需求，支持實(shí)現(xiàn)7LPP和8LPP工藝技術(shù);三星客戶可開發(fā)各類復(fù)雜的高階節(jié)點(diǎn)設(shè)計，充分滿足移動市場和其他垂直市場的應(yīng)用需求。
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Cadence弄潮神經(jīng)網(wǎng)絡(luò)，發(fā)布高性能DSP IP
- 作者 王瑩 近日，Cadence發(fā)布了首款面向汽車、監(jiān)控、無人機(jī)和移動市場的神經(jīng)網(wǎng)絡(luò)DSP IP，引起了業(yè)界的關(guān)注?！adence公司Tensilica事業(yè)部資深市場群總監(jiān)Steve Roddy專程來到北京，向媒體介紹其特點(diǎn)?！ ≡谏窠?jīng)網(wǎng)絡(luò)的器件方面，英偉達(dá)主宰了通用GPU。此次Cadence Tensilica發(fā)布的神經(jīng)網(wǎng)絡(luò)DSP IP則是面向嵌入式芯片?！ ⊥ǔＦ渌焉痰姆桨甘敲嫦蛞粋€卷積神經(jīng)網(wǎng)絡(luò)(CNN)層，而最新的Cadence Tensilica Vision C5 DSP由于可配置，可以面
- 關(guān)鍵字： Cadence 神經(jīng)網(wǎng)絡(luò)DSP IP Steve Roddy 201706
Cadence弄潮神經(jīng)網(wǎng)絡(luò)，發(fā)布高性能DSP IP
- 近日，Cadence發(fā)布了首款面向汽車、監(jiān)控、無人機(jī)和移動市場的神經(jīng)網(wǎng)絡(luò)DSP?IP，引起了業(yè)界的關(guān)注。 實(shí)際上，多家公司正在推出或研制神經(jīng)網(wǎng)絡(luò)IP、c/解決方案。Cadence的方案有何優(yōu)勢?Cadence公司Tensilica事業(yè)部資深市場群總監(jiān)Steve?Roddy為此專程來到北京，向媒體介紹其特點(diǎn)。 Vision?C5概況 在神經(jīng)網(wǎng)絡(luò)的器件方面，英偉達(dá)主宰了通用GPU。此次Cadence?Tensilica發(fā)布的神經(jīng)網(wǎng)絡(luò)DSP?IP則是面
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Cadence發(fā)布業(yè)界首款面向汽車、監(jiān)控、無人機(jī)和移動市場的神經(jīng)網(wǎng)絡(luò)DSP IP
- 楷登電子(美國Cadence公司)今日正式公布業(yè)界首款獨(dú)立完整的神經(jīng)網(wǎng)絡(luò)DSP —Cadence? Tensilica? Vision C5 DSP，面向?qū)ι窠?jīng)網(wǎng)絡(luò)計算能力有極高要求的視覺設(shè)備、雷達(dá)/光學(xué)雷達(dá)和融合傳感器等應(yīng)用量身優(yōu)化。針對車載、監(jiān)控安防、無人機(jī)和移動/可穿戴設(shè)備應(yīng)用，Vision C5 DSP 1TMAC/s的計算能力完全能夠勝任所有神經(jīng)網(wǎng)絡(luò)的計算任務(wù)。如需了解更多內(nèi)容，請參訪www.cadence.co
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Cadence發(fā)布7納米工藝Virtuoso先進(jìn)工藝節(jié)點(diǎn)擴(kuò)展平臺
- 楷登電子(美國Cadence公司)今日正式發(fā)布針對7nm工藝的全新Virtuoso® 先進(jìn)工藝節(jié)點(diǎn)平臺。通過與采用7nm FinFET工藝的早期客戶展開緊密合作，Cadence成功完成了Virtuoso定制設(shè)計平臺的功能拓展，新平臺能幫助客戶管理由于先進(jìn)工藝所導(dǎo)致的更復(fù)雜的設(shè)計以及特殊的工藝效應(yīng)。新版Virtuoso先進(jìn)工藝平臺同樣支持所有主流FinFET先進(jìn)節(jié)點(diǎn)，性能已得到充分認(rèn)證;同時提高了7nm工藝的設(shè)計效率。 為了應(yīng)對7nm設(shè)計的眾多技術(shù)挑戰(zhàn)，Virtuoso先進(jìn)工藝平臺提供豐富
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Cadence Design Systems Inc.是全球最大的電子設(shè)計技術(shù)(Electronic Design Technologies)、程序方案服務(wù)和設(shè)計服務(wù)供應(yīng)商。其解決方案旨在提升和監(jiān)控半導(dǎo) [ 查看詳細(xì) ]
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