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cadence reality 文章進入cadence reality技術(shù)社區(qū)

低成本多路輸出CMOS帶隙基準電壓源設(shè)計

摘要：在傳統(tǒng)Brokaw帶隙基準源的基礎(chǔ)上，提出一種采用自偏置結(jié)構(gòu)和共源共柵電流鏡的低成本多路基準電壓輸出的CMOS帶隙基準源結(jié)構(gòu)，省去了一個放大器，并減小了所需的電阻阻值，大大降低了成本，減小了功耗和噪聲。該
關(guān)鍵字：帶隙基準源多路基準電壓輸出溫度系數(shù) Cadence

ARM攜手Cadence：開發(fā)基于TSMC 16納米FinFET的A57處理器

ARM和Cadence近日宣布合作細節(jié)，揭示其共同開發(fā)首款基于臺積電16納米FinFET制程的ARM?Cortex?-A57處理器，實現(xiàn)對16納米性能和功耗縮小的承諾。測試芯片是采用完整的Cadence RTL-to-signoff流程、 Cadence Virtuoso 定制設(shè)計平臺、ARM Artisan?標準單元庫和臺積電的存儲器的宏 ? ??? Cortex -A57處理器是ARM迄今為止性能最高的處理器，基于新的64位指令集
關(guān)鍵字： Cadence 設(shè)計 EDA

Cadence和TSMC為16納米FinFET開發(fā)設(shè)計架構(gòu)

Cadence設(shè)計系統(tǒng)公司4月9日宣布與TSMC簽訂了一項長期合作協(xié)議，共同開發(fā)16納米FinFET技術(shù)，以其適用于移動、網(wǎng)絡(luò)、服務(wù)器和FPGA等諸多應(yīng)用領(lǐng)域。此次合作非常深入，開始于工藝制造的早期階段，貫穿于設(shè)計分析至設(shè)計簽收，全面有效解決FinFETs設(shè)計存在的問題，從而交付能實現(xiàn)超低功耗、超高性能芯片的設(shè)計方案。 ????在16納米及以下工藝技術(shù)下設(shè)計開發(fā)系統(tǒng)級芯片設(shè)計（SoC），只有FinFET 技術(shù)才具備功率、性能和面積上（PPA）的獨特優(yōu)勢。與平面FE
關(guān)鍵字： Cadence 設(shè)計 EDA

ARM攜Cadence開發(fā)Cortex-A57 64位處理器

ARM (LSE:ARM; Nasdaq: ARMH) 和Cadence (NASDAQ: CDNS) 日前宣布合作細節(jié)，揭示其共同開發(fā)首款基于臺積電16納米FinFET制程的ARM?Cortex?-A57處理器，實現(xiàn)對16納米性能和功耗縮小的承諾。測試芯片是采用完整的Cadence RTL-to-signoff流程、 Cadence Virtuoso 定制設(shè)計平臺、ARM Artisan?標準單元庫和臺積電的存儲器的宏。
關(guān)鍵字： ARM Cadence 處理器 Cortex-A57

電路設(shè)計模塊化與設(shè)計重利用

摘要：本文主要介紹了在Cadence Board Design System上實現(xiàn)電路設(shè)計模塊化與設(shè)計重利用的設(shè)計方法。
關(guān)鍵詞：Cadence Concept—HDL；原理圖；子電路；模塊化；層次化

隨著電路設(shè)計復雜程度的增加，設(shè)計
關(guān)鍵字： Cadence Concept&mdash HDL 原理圖子電路模塊化層次化

Cadence宣布收購Tensilica

　　Tensilica公司的數(shù)據(jù)平面處理單元(DPUs)與Cadence公司的設(shè)計IP相結(jié)合，將為移動無線、網(wǎng)絡(luò)基礎(chǔ)設(shè)施、汽車信息娛樂和家庭應(yīng)用等各方面提供更優(yōu)化的IP解決方案。　　作為業(yè)界標準處理器架構(gòu)的補充，Tensilica公司的IP提供了應(yīng)用優(yōu)化的子系統(tǒng)，以提高產(chǎn)品的辨識度和更快地進入市場。　　全球持有Tensilica公司IP授權(quán)許可的公司超過200個，包括系統(tǒng)OEM制造商及世界前10大半導體公司中的7家。Tensilica的IP核在全球的總出貨量已超過20億枚。　　2013年3月1
關(guān)鍵字： Cadence IP

Cadence宣布收購Tensilica

?　　· Tensilica公司的數(shù)據(jù)平面處理單元(DPUs)與Cadence公司的設(shè)計IP相結(jié)合，將為移動無線、網(wǎng)絡(luò)基礎(chǔ)設(shè)施、汽車信息娛樂和家庭應(yīng)用等各方面提供更優(yōu)化的IP解決方案。　　· 作為業(yè)界標準處理器架構(gòu)的補充，Tensilica公司的IP提供了應(yīng)用優(yōu)化的子系統(tǒng)，以提高產(chǎn)品的辨識度和更快地進入市場。　　· 全球持有Tensilica公司IP授權(quán)許可的公司超過200個，包括系統(tǒng)OEM制造商及世界前10大半導體公司中的7家。Tensilic
關(guān)鍵字： Cadence Tensilica 嵌入式

GLOBALFOUNDRIES與三星支持最新Cadence Virtuoso先進節(jié)點

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司 (NASDAQ: CDNS)，日前宣布其兩家主要晶圓代工廠合作伙伴--三星晶圓廠與GLOBALFOUNDRIES已經(jīng)支持最新Cadence面向20與14納米先進節(jié)點設(shè)計的定制/模擬技術(shù)。兩家晶圓廠正在為新推出的Cadence Virtuoso先進節(jié)點提供基于SKILL的工藝設(shè)計工具包(PDK)。
關(guān)鍵字： Cadence 三星晶圓

Cadence與GLOBALFOUNDRIES合作推動20納米生產(chǎn)工藝的定制/模擬與數(shù)字設(shè)計

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前宣布GLOBALFOUNDRIES已經(jīng)認證關(guān)鍵的Cadence技術(shù)，用于其20納米LPM技術(shù)的定制/模擬、數(shù)字和混合信號設(shè)計、實現(xiàn)和驗證。驗證涵蓋了Virtuoso和Encounter平臺，包括業(yè)界標準的SKILL工藝設(shè)計工具包(PDK)。
關(guān)鍵字： Cadence 20納米 LPM

Cadence協(xié)議收購Cosmic Circuits,擴張IP業(yè)務(wù)

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計系統(tǒng)公司(納斯達克：CDNS)，日前宣布協(xié)議收購Cosmic Circuits 私人有限公司，這是一家領(lǐng)先的以模擬和混合信號IP為核心的公司。Cosmic Circuits提供在40nm和28nm工藝節(jié)點上經(jīng)過硅驗證的接口類及先進的混合信號IP解決方案，20nm和FinFET的產(chǎn)品正在開發(fā)中。
關(guān)鍵字： Cadence Cosmic 混合信號

半導體業(yè)新的驅(qū)動力在哪里

編者按：不久前，Cadence在華舉行了進入中國20周年的慶典;今年又將迎來30歲華誕。三十而立，Cadence作為EDA(電子設(shè)計自動化)工具的領(lǐng)軍企業(yè)，如何看待半導體業(yè)?對我國本土IC設(shè)計業(yè)有何建議?
關(guān)鍵字： Cadence EDA 201301

新版Cadence Incisive平臺可將SoC驗證效率提升一倍

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence設(shè)計系統(tǒng)公司(NASDAQ: CDNS)，日前公布了一個新版的尖端功能驗證平臺與方法學，擁有全套最新增強功能，與之前發(fā)布的版本相比，可將SoC驗證效率提高一倍。Incisive ?12.2提供了兩倍性能，全新Incisive調(diào)試分析器產(chǎn)品，全新低功耗建模，以及當今復雜IP與SoC高效驗證所需的數(shù)百種其他功能。
關(guān)鍵字： Cadence Incisive SoC

Cadence：做大，更要做強

收購是做大的一種途徑。EDA工具業(yè)給人的印象是三大公司稱雄，并購案時有發(fā)生。并購使大者恒大，資本、技術(shù)密集。例如Cadence一直在陸續(xù)收購。Cadence在埋頭把核心技術(shù)和客戶服務(wù)搞好后，有了充足的盈利就考慮收購公司，以給股東帶來更大的回報。
關(guān)鍵字： Cadence 設(shè)計 EDA

Cadence合成技術(shù)為Renesas微系統(tǒng)公司加快生產(chǎn)時間

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè) Cadence 設(shè)計系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布 Renesas 微系統(tǒng)有限公司已采用 Cadence? Encounter? RTL Compiler 用于綜合實現(xiàn)，尤其是將復雜 ASIC 設(shè)計的芯片利用率提高了 15%，面積減少了 8.4%，加速了實現(xiàn)周期并降低了成本。
關(guān)鍵字： Cadence Renesas 微系統(tǒng) ASIC

Cadence推出首款以太網(wǎng)汽車連接性的設(shè)計IP和驗證IP

全球電子設(shè)計創(chuàng)新領(lǐng)先企業(yè)Cadence 設(shè)計系統(tǒng)公司 (NASDAQ:CDNS) 日前宣布將很快推出業(yè)界首款用于最新的汽車以太網(wǎng)控制器的汽車以太網(wǎng)設(shè)計 IP 和驗證 IP (VIP)。基于標準的設(shè)計 IP 和 VIP 支持由 OPEN Alliance Special Interest Group (SIG) 定義的最新汽車以太網(wǎng)擴展。
關(guān)鍵字： Cadence 以太網(wǎng)

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cadence reality介紹

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