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DS/FH混合擴(kuò)頻接收機(jī)解擴(kuò)及同步技術(shù)的FPGA實(shí)現(xiàn)
- 研究采用編碼擴(kuò)頻的DS/FH混合擴(kuò)頻接收機(jī)的核心模塊――同步及解擴(kuò)部分的FPGA實(shí)現(xiàn)結(jié)構(gòu)。將多種專用芯片的功能集成在一片大規(guī)模FPGA芯片上，實(shí)現(xiàn)了接收機(jī)的高度集成化、小型化。偽碼的串并混合捕獲算法及跳頻同步算法等均采用硬件完成，提高了捕獲速度。實(shí)驗(yàn)結(jié)果證明該方案是正確可行的。
- 關(guān)鍵字： 技術(shù) FPGA 實(shí)現(xiàn) 同步 擴(kuò)及 混合 擴(kuò)頻 接收機(jī) DS/FH 轉(zhuǎn)換器
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