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基于FPGA全新鎖相倍頻系統(tǒng)的設計
- 給出了DPLL的基本概念，闡述了DPLL的缺點，并結合最新的模擬鎖相和數字鎖相技術，提出了一種基于FPGA的全新鎖相倍頻系統(tǒng)的設計方法，簡單地介紹了設計的思路、原理及其算法，并對該方案的性能進行了分析，給出了仿真波形。
- 關鍵字： DPLL 鎖相倍頻系統(tǒng) 模擬鎖相 數字鎖相
寬頻帶數字鎖相環(huán)的設計及基于FPGA的實現
- 本文簡要介紹了在FPGA中實現全數字鎖相環(huán)(DPLL)的原理與方法，以解決在同步串行數據通信時的同步時鐘不穩(wěn)定時的快速恢復問題； 并重點介紹了采用可控模數分頻器實現的數字鎖相環(huán)中寬頻帶捕獲的方法與實現過程。
- 關鍵字： DPLL FPGA 數字環(huán)路濾波器 時鐘恢復 寬頻帶
寬頻帶數字鎖相環(huán)的設計及基于FPGA的實現
- 摘要: 本文簡要介紹了在FPGA中實現全數字鎖相環(huán)(DPLL)的原理與方法，以解決在同步串行數據通信時的同步時鐘不穩(wěn)定時的快速恢復問題； 并重點介紹了采用可控模數分頻器實現的數字鎖相環(huán)中寬頻帶捕獲的方法與實現過程。關鍵詞: DPLL；FPGA；數字環(huán)路濾波器；時鐘恢復；寬頻帶 引言數字鎖相環(huán)(DPLL)技術在數字通信、無線電電子學等眾多領域得到了極為廣泛的應用。與傳統(tǒng)的模擬電路實現的PLL相比，DPLL具有精度高、不受溫度和電壓影響、環(huán)路帶寬和中心頻率編程可調、易于構建高階鎖相環(huán)等優(yōu)
- 關鍵字： DPLL 單片機 寬頻帶 嵌入式系統(tǒng) 數字鎖相環(huán)
基于FPGA的高速數字鎖相環(huán)的設計與實現
- 摘 要：本文提出了一種利用邊沿觸發(fā)鑒相縮短鎖相環(huán)捕獲時間的方案，并詳細介紹了該方案基于FPGA的實現方法。通過對所設計的鎖相環(huán)進行計算機仿真和硬件測試，表明該方案確實可以提高鎖相環(huán)的捕獲性能。關鍵詞：數字鎖相環(huán)(DPLL)；捕獲時間；FPGA；VHDL引言捕獲時間是鎖相環(huán)的一個重要參數，指的是鎖相環(huán)從起始狀態(tài)到達鎖定狀態(tài)所需時間。在一些系統(tǒng)中，如跳頻通信系統(tǒng)，由于系統(tǒng)工作頻率不斷地發(fā)生快速變化(每秒幾百次到幾千次，甚至高達上萬次)，要求鎖相環(huán)能夠對信號相位快速捕獲。因此
- 關鍵字： FPGA VHDL 捕獲時間 數字鎖相環(huán)(DPLL)
全數字鎖相環(huán)的設計
- 摘要：本文在說明全數字鎖相環(huán)的基礎上，提出了一種利用FPGA設計一階全數字鎖相環(huán)的方法，并給出了關鍵部件的RTL可綜合代碼，并結合本設計的一些仿真波形詳細描述了數字鎖相環(huán)的工作過程，最后對一些有關的問題進行了討論。關鍵詞：全數字鎖相環(huán)；DPLL；FSK；FPGA 引言鎖相環(huán)(PLL)技術在眾多領域得到了廣泛的應用。如信號處理，調制解調，時鐘同步，倍頻，頻率綜合等都應用到了鎖相環(huán)技術。傳統(tǒng)的鎖相環(huán)由模擬電路實現，而全數字鎖相環(huán)(DPLL)與傳統(tǒng)的模擬電路實現的PLL相比，具有精度高且不受溫度和電壓影響，環(huán)路
- 關鍵字： DPLL FPGA FSK 全數字鎖相環(huán)
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dpll介紹
背景知識：
隨著數字電路技術的發(fā)展，數字鎖相環(huán)在調制解調、頻率合成、FM 立體聲解碼、彩色副載波同步、圖象處理等各個方面得到了廣泛的應用。數字鎖相環(huán)不僅吸收了數字電路可靠性高、體積小、價格低等優(yōu)點，還解決了模擬鎖相環(huán)的直流零點漂移、器件飽和及易受電源和環(huán)境溫度變化等缺點，此外還具有對離散樣值的實時處理能力，已成為鎖相技術發(fā)展的方向。鎖相環(huán)是一個相位反饋控制系統(tǒng)，在數字鎖相環(huán)中，由于誤差控制信號 [ 查看詳細 ]
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