萊迪思 文章 進入萊迪思技術社區(qū)
NU HORIZONS ELECTRONICS成為萊迪思半導體全球代理商
- 萊迪思半導體公司今日宣布Nu Horizons Electronics Corp. 即日起將在全球范圍內(nèi)代理萊迪思的全部產(chǎn)品。Nu Horizons目前在整個亞太地區(qū)代理萊迪思產(chǎn)品。 Nu Horizons全球代理部總裁Kent Smith 表示：“Nu Horizons Electronics 非常高興能與萊迪思一起拓展全球業(yè)務。萊迪思是全球領先的FPGA、PLD、可編程時鐘和電源管理器件、軟件設計工具和IP核供應商之一，并且我們的全球銷售和工程師團隊對于可編程邏輯技術非常了解。萊
- 關鍵字： 萊迪思 FPGA PLD 可編程時鐘 電源管理器件
萊迪思推出適用于SERDES 和視頻時鐘分配的開發(fā)平臺
- 萊迪思半導體公司今日發(fā)布ispClock 5400D 可編程時鐘器件的評估板，價格為169美元。這款新的評估板是適用于ispClock5400D差分時鐘分配器件的評估和設計的易于使用的開發(fā)平臺。該款評估板還可以用于查看5400D器件的性能和在系統(tǒng)編程，或者用作LatticeECP3™ FPGA串行協(xié)議或視頻協(xié)議評估板的副板或時鐘源。 通常，只有帶有LVDS或LVPECL接口的價格昂貴的振蕩器才可用作FPGA SERDES接口應用的參考時鐘源。而現(xiàn)在ispClock5400D器件提供超
- 關鍵字： 萊迪思 開發(fā)平臺 LatticeECP3
用內(nèi)部邏輯分析儀調(diào)試FPGA(08-100)
- 進行硬件設計的功能調(diào)試時，F(xiàn)PGA的再編程能力是關鍵的優(yōu)點。CPLD和FPGA早期使用時，如果發(fā)現(xiàn)設計不能正常工作，工程師就使用“調(diào)試鉤”的方法。先將要觀察的FPGA內(nèi)部信號引到引腳，然后用外部的邏輯分析儀捕獲數(shù)據(jù)。然而當設計的復雜程度增加時，這個方法就不再適合了，其中有幾個原因。第一是由于FPGA的功能增加了，而器件的引腳數(shù)目卻緩慢地增長。因此，可用邏輯對I/O的比率減小了，參見圖1。此外，設計很復雜時，通常完成設計后只有幾個空余的引腳，或者根本就沒有空余的引腳能用于調(diào)試。
- 關鍵字： 萊迪思 FPGA 邏輯分析儀
為FPGA軟處理器選擇操作系統(tǒng)(08-100)
- 操作系統(tǒng)能夠提高可移植性，并提供多種經(jīng)過測試的抽象層，服務層和應用模塊層以供選擇，從而加快產(chǎn)品上市時間并減少應用程序出錯的可能性。然而，選擇一個嵌入式操作系統(tǒng)( OS )從來就不是一個簡單的過程，因為集成嵌入式軟件的方式選擇余地很大，你可以完全都由自己來編寫，或通過商業(yè)定制專門實時操作系統(tǒng)，也可以直接購買通用操作系統(tǒng)不作任何修改，現(xiàn)成的通用操作系統(tǒng)。FPGA性能的提高和軟處理器核的出現(xiàn)，直接導致了可編程邏輯SoC解決方案的產(chǎn)生，隨著這一變化，關于選擇標準，設計方案以及折中考慮等傳統(tǒng)經(jīng)驗也需要與時俱進以
- 關鍵字： 萊迪思 FPGA 操作系統(tǒng)
萊迪思為LatticeECP2低成本FPGA擴展市場
- --第二代 EConomy Plus器件降低了50%的價格并達到雙倍的密度 -- 萊迪思半導體公司近日公布了其第二代EConomy Plus 現(xiàn)場可編程門陣列 (FPGA)器件，LatticeECP2系列。用了富士通90納米CMOS工藝和300毫米硅片，在大批量的情況下，此系列使得FPGA價格降到每1000查找表（LUT）低于0.50美元。與130納米 LatticeECP FPGA相比，新的系
- 關鍵字： LatticeECP2 萊迪思 市場
萊迪思富士通發(fā)布LatticeSC和LatticeECP2
- －通力合作打造出難以超越的FPGA產(chǎn)品系列－ 萊迪思半導體公司近日宣布推出其新一代的90納米FPGA，包含兩個全新的FPGA器件系列。LatticeSC™ 系統(tǒng)芯片F(xiàn)PGA的設計宗旨是提供業(yè)界最佳的整體性能，而LatticeECP2™ FPGA則將業(yè)界成本最低的FPGA結構和高端的FPGA功能集于一身。這兩個器件系列都采用了富士通公司經(jīng)過優(yōu)化的工藝，既滿足了高容量FPGA對成本效率的要求，又能夠提供擁有數(shù)百萬門的系統(tǒng)級FPGA所需的千兆赫性能。這兩個器件系列將在
- 關鍵字： LatticeECP2 LatticeSC 富士通 萊迪思
用可編程的扭斜控制來解決時鐘網(wǎng)絡問題的方法
- 時鐘網(wǎng)絡管理問題提高同步設計的整體性能的關鍵是提高時鐘網(wǎng)絡的頻率。然而，諸如時序裕量、信號完整性、相關時鐘邊沿的同步等因素極大地增加了時鐘網(wǎng)絡設計的復雜度。傳統(tǒng)上，時鐘網(wǎng)絡的設計采用了簡單的元件，諸如扇出緩沖器、時鐘發(fā)生器、延時線、零延時緩沖器和頻率合成器。由于PCB走線長度不等而引起的時序誤差，采用蜿蜒走線設計的走線長度匹配方法來處理。走線阻抗與輸出驅動阻抗的不匹配經(jīng)常通過反復試驗選擇串聯(lián)電阻來消除。多種信號的標準使得時鐘邊沿的同步更加復雜。至今，這三種挑戰(zhàn)會經(jīng)常遇到，并且鮮有理想的解決方案。以下描述了
- 關鍵字： 萊迪思
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