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        3系列FPGA中使用LUT構(gòu)建分布式RAM(1)

        作者: 時(shí)間:2017-10-13 來(lái)源:網(wǎng)絡(luò) 收藏

        前一陣出差,然后又吹空調(diào)受涼休息了一陣子,耽誤了不少時(shí)間。現(xiàn)在緩過(guò)勁來(lái)了,可以繼續(xù)寫(xiě)作了。出差途中數(shù)小時(shí)路上無(wú)聊,就順手打印了XAPP463.pdf,即《Using Block in Spartan-3 GeneraTIon s》,深感配置的靈活與復(fù)雜性。在此把閱讀此應(yīng)用報(bào)告的心得分享一下,歡迎大家交流。

        在賽靈思Spartan-3、3E等系列的中,其邏輯單元CLB中一般含有不同數(shù)量的單端口(S)或者雙端口RAM(DRAM),這里的“單”或者“雙”是由我們開(kāi)發(fā)人員定義的。一般情況下這種RAM分布于(distributed)FPGA的陣列結(jié)構(gòu)中,所以被稱(chēng)為“分布式RAM”,以便區(qū)別于FPGA中的塊RAM(block RAM);它們的詳細(xì)區(qū)別大家可以看Spartan3系列的用戶(hù)手冊(cè)(UG331.pdf, Spartan-3 GeneraTIon FPGA User Guide),其中對(duì)所有模塊及其功能都有最全面的解釋?zhuān)ǜ鞣N復(fù)雜的時(shí)序分析。分布式RAM在局部設(shè)計(jì)中可以方便地實(shí)現(xiàn)小的數(shù)據(jù)緩存區(qū)、FIFO或者寄存器組等等。接下來(lái)我們討論分布式RAM的特征、功能以及如何使用Xilinx的工具來(lái)調(diào)用分布式RAM。

        本文引用地址:http://www.antipu.com.cn/article/201710/365634.htm

        圖1 分布式RAM的示意

        關(guān)鍵詞: FPGA LUT RAM

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