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        基于DDS+PLL高性能頻率合成器的設計與實現(xiàn)

        作者: 時間:2010-04-20 來源:網(wǎng)絡 收藏

          環(huán)路濾波器對的性能有十分重要的影響,環(huán)路濾波器決定的雜散抑制、相位噪聲、環(huán)路穩(wěn)定性以及捷變時間等重要參數(shù)。由于本采用ADF4113電流型電荷泵鑒相器,因此環(huán)路濾波器采用無源方式。鑒于本系統(tǒng)對跳頻的切換時間要求不是很高,因此可以適當降低環(huán)路帶寬,以確保系統(tǒng)穩(wěn)定性。降低環(huán)路帶寬還有助于濾除參考信號中的諧波成分。但環(huán)路帶寬太小會增加建立時間和帶內VCO相位噪聲,由于帶內噪聲主要取決于參考信號引入的噪聲,VC0相位噪聲不是主要因素。該系統(tǒng)成三階無源濾波器構成的四階環(huán)路。圖4虛線框給出三階無源環(huán)路濾波器電路,根據(jù)系統(tǒng)對相位噪聲和轉換時間的要求,取環(huán)路帶寬ωc=15 kHz,相位裕度為φ=45°。

          2 電路仿真

          采用ADISim軟件對該方案進行了仿真分析,圖5給出仿真結果??梢钥闯觯擃l率的相位噪聲為-84.63 dBc/

          3 結果分析

          系統(tǒng)采用直接激勵方案,充分利用了小步進、頻率捷變快及頻帶寬,工作頻率高,頻譜純度高的優(yōu)點,研制出滿足GSM l 800 MHz系統(tǒng)指標要求的頻率合成器。相位噪聲的測量如圖6所示,為-83.75 dBc/

          4 結語

          采用激勵PLL的頻率合成技術,克服了寬帶系統(tǒng)中DDS輸出頻率較低和PLL頻率分辨率低的缺點。通過合理設計環(huán)路低通濾波器、相位噪聲、環(huán)路穩(wěn)定性等性能得到提高,并對電源采取濾波措施,以改善雜波抑制,最終設計出頻率合成器。


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