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        基于FPGA的多軸控制器設計

        • 介紹了一種基于FPGA的多軸控制器,控制器主要由ARM7(LPC2214)和FPGA(EP2C5T144C8)及其外圍電路組成,用于同時控制多路電機的運動。利用Verilog HDL硬件描述語言在FPGA中實現(xiàn)了電機控制邏輯,主要包括脈沖控制信號產生、加減速控制、編碼器反饋信號的辨向和細分、絕對位移記錄、限位信號保護邏輯等。論文中給出了FPGA內部一些核心邏輯單元的實現(xiàn),并利用QuartusⅡ、Modelsim SE軟件對關鍵邏輯及時序進行了仿真。實際使用表明該控制器可以很好控制多軸電機的運動,并且能
        • 關鍵字: VerilogHDL  FPGA  多軸控制器  編碼器  四細分  

        基于VerilogHDL的FIR數(shù)字濾波器設計與仿真

        • 引言數(shù)字濾波器是語音與圖像處理、模式識別、雷達信號處理、頻譜分析等應用中的一種基本的處理部件, ...
        • 關鍵字: VerilogHDL  FIR數(shù)字濾波器    

        基于VerilogHDL語言的FIR數(shù)字濾波器設計與實現(xiàn)

        •  隨著現(xiàn)場可編程門陣列的廣泛應用,對其進行靈活的重新配置的研究也越來越多。目前絕大多數(shù)FPGA都是基于查找表LUT(Look UP Table)的技術,采用SRAM工藝生產。這種工藝的FPGA有兩層結構,上層為配置存儲器,下層是
        • 關鍵字: 濾波器  設計  實現(xiàn)  數(shù)字  FIR  VerilogHDL  語言  基于  

        VerilogHDL綜合性設計

        • VerilogHDL綜合性設計  1 時鐘安排  選用上升沿觸發(fā)的單時鐘信號,盡量不使用混合觸發(fā)的時鐘信號。因為時鐘周期在時序分析的過程中是關鍵問題,它還影響到時鐘的頻率。使用簡單的時鐘結構 利于時鐘信號的分析和保持
        • 關鍵字: 設計  綜合性  VerilogHDL  

        基于VerilogHDL濾波器的設計

        • 現(xiàn)代計算機和通信系統(tǒng)中廣泛采用數(shù)字信號處理的技術和方法,其基本思路是先把信號用一系列的數(shù)字來表示,然后對...
        • 關鍵字: 濾波器  VerilogHDL  

        基于FPGA的空間存儲器的糾錯系統(tǒng)的設計

        基于VerilogHDL的CMOS圖像敏感器驅動電路設計

        • Verilog HDL語言是IEEE標準的用于邏輯設計的硬件描述語言,具有廣泛的邏輯綜合工具支持,簡潔易于理解。本文就STAR250這款CMOS圖像敏感器,給出使用Verilog HDL語言設計的邏輯驅動電路和仿真結果。
        • 關鍵字: 驅動  電路設計  敏感  圖像  VerilogHDL  CMOS  基于  

        基于VerilogHDL的小波濾波器的設計與實現(xiàn)

        • 0 引 言
          現(xiàn)代計算機和通信系統(tǒng)中廣泛采用數(shù)字信號處理的技術和方法,其基本思路是先把信號用一系列的數(shù)字來表示,然后對這些數(shù)字信號進行各種快速的數(shù)學運算。其目的是多種多樣的,有的是為了加密,有的是為了去
        • 關鍵字: VerilogHDL  小波濾波器    

        基于VerilogHDL的背景噪聲扣除電路設計

        • 本文介紹了一種基于硬件描述語言VerilogHDL的背景噪聲扣除電路設計,該設計與以往使用加減計數(shù)芯片組成的電路相比,具有與MCU接口簡單,軟件操作方便等優(yōu)點。
        • 關鍵字: VerilogHDL  背景  電路設計    
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