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簡析BOOST-BUCK變換器
- 摘要：本文提出一種新型的BOOST-BUCK變換器，該變換器具有輸入輸出電流連續(xù)，輸出電壓可調范圍大等優(yōu)點。由于該變換器的輸入電流連續(xù)，該變換器適合于功率因數(shù)校正電路，且其實現(xiàn)較為簡單。該變換器的輸出電壓可調范
- 關鍵字： BOOST-BUCK 變換器
Xilinx推出LogiCORE Turbo編解碼器解決方案
- 賽靈思公司（Xilinx, Inc.）推出針對LTE無線系統(tǒng)的性能優(yōu)化可編程Turbo編碼解決方案。利用Spartan® 和 Virtex®現(xiàn)場可編程門陣列（FPGA）嵌入的數(shù)字信號處理（DSP）能力, 新推出的Xilinx 3GPP LTE Turbo 編碼器和解碼器LogiCORE™ 產品提供了高達200 Mbps的吞吐能力，可滿足不斷演化的長期演進（LTE）標準對現(xiàn)代無線系統(tǒng)提出的語音和日益增長的數(shù)據(jù)通信要求。 Turbo碼最初專為3G無線系統(tǒng)的商用
- 關鍵字： Xilinx LTE Turbo FPGA DSP 編碼器 解碼器
突發(fā)通信中Turbo碼的FPGA實現(xiàn)
- Turbo碼一種低信噪比條件下也能達到優(yōu)異糾錯性能的信道編碼。早期為了強調Turbo碼接近香農限的優(yōu)異性能，研究的碼字度非常大[1～2]，存在譯碼復雜度大、譯碼時延長等問題。突發(fā)數(shù)據(jù)通信以傳輸中小長度的數(shù)據(jù)報文業(yè)務為主，所以突發(fā)通信中的Turbo碼的碼長也是中等長度以下的。本文面向突發(fā)數(shù)據(jù)通信中的信道編碼應用，研究了短幀長Turbo碼編譯碼算法的FPGA實現(xiàn)。實現(xiàn)中采用了優(yōu)化的編譯碼算法，以降低譯碼復雜度和譯碼延時。最后仿真和測試了Turbo譯碼器的糾錯性能和吞吐量。 1 Turbo碼編碼器的F
- 關鍵字： Turbo FPGA RSC
Cadence新技術加速模擬和混合信號驗證
- 全球電子設計創(chuàng)新領先企業(yè)Cadence設計系統(tǒng)公司(納斯達克: CDNS)，今天宣布Cadence®Virtuoso® Spectre® Circuit Simulator中的高級“turbo”技術目前已經推出，這是業(yè)界領先的模擬SPICE電路仿真器，獲得了全面的晶圓廠支持。這種turbo技術能夠在提升性能的同時，確保硅片的精確性，讓設計師能夠驗證他們復雜的大型模擬設計，例如PLL(phase-locked loops)、ADC(analog-to-di
- 關鍵字： Cadence turbo Cadence?Virtuoso? Spectre? Circuit Simulator
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