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FPGA：EPP（增強(qiáng)型并行端口）

EPP 使與 PC 的通信變得快速而簡單。在這里，我們使用Pluto-P FPGA板與支持EPP的PC進(jìn)行通信。EPP 1 - 什么是 EPP？EPP 是 IEEE 1284（并行端口標(biāo)準(zhǔn)）的一部分。IEEE 1284 還定義了 SPP 和 ECP，但 EPP 提供了兩者的優(yōu)點(diǎn)，即速度和簡單性。EPP的主要特點(diǎn)是：通過并行端口提供雙向通信，即對連接到 PC 并行端口的外圍設(shè)備進(jìn)行讀寫的方式。事務(wù)是 8 位寬的，并且是原子的。主機(jī) （PC）始終是事務(wù)的發(fā)起者，讀取或?qū)懭?。沒有爆發(fā)的概念。您可以發(fā)
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FPGA：SPI接口

SPI可以用作FPGA和其他芯片之間簡單有效的通信方式。SPI 1 - 什么是SPI？SPI是一個簡單的接口，允許一個芯片與一個或多個其他芯片進(jìn)行通信。它看起來如何？讓我們從一個簡單的例子開始，其中只有兩個芯片必須一起通信。SPI 需要在兩個芯片之間使用 4 根線。如您所見，這些電線被稱為 SCK、MOSI、MISO 和 SSEL，其中一個芯片是“主芯片”，另一個芯片是“從芯片”。SPI基礎(chǔ)知識基本上：它是同步的。它是全雙工串行。它不是即插即用的。有一個（也只有一個）主站和一個或多個（或多個）從站。更多細(xì)
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PSG獨(dú)立運(yùn)作拯救的是英特爾還是FPGA

根據(jù)英特爾官方的公告，2024年1月1日起，可編程解決方案部門（PSG）將獨(dú)立運(yùn)營，并計劃2年內(nèi)開啟IPO。值得一提的是，英特爾的PSG其實就是以2015年5月達(dá)成收購協(xié)議的Altera為主體，從當(dāng)年花費(fèi)167億美元成為英特爾最大一筆收購，到現(xiàn)在要獨(dú)立運(yùn)營甚至上市套現(xiàn)，種種操作背后蘊(yùn)含了哪些原因我們不得而知，不過這筆投資的回報價值幾何也許能終見分曉。在半導(dǎo)體行業(yè)，作為霸占銷售額榜首位置最久的公司，英特爾在收購方面表現(xiàn)得一直很積極，但從另一個角度來看，英特爾的收購交易獲得較高評價的也不多，很多交易即使計算
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FPGA串行接口（RS-232）

串行接口是將FPGA連接到PC的簡單方法。我們只需要一個發(fā)射器和接收器模塊。異步發(fā)射器它通過序列化要傳輸?shù)臄?shù)據(jù)來創(chuàng)建信號“TxD”。異步接收器它從 FPGA 外部獲取信號“RxD”，并將其“解串化”，以便在 FPGA 內(nèi)部輕松使用。串行接口 1 - RS-232 串行接口的工作原理RS-232接口具有以下特點(diǎn)：使用 9 針連接器“DB-9”（較舊的 PC 使用 25 針“DB-25”）。允許雙向全雙工通信（PC可以同時發(fā)送和接收數(shù)據(jù)）?？梢砸源蠹s 10KBytes/s 的最大速度進(jìn)行通信。DB-9 連接
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FPGA計數(shù)器的藝術(shù)

計數(shù)器構(gòu)成了一個基本的FPGA構(gòu)建塊。它們有各種形狀和形式......計數(shù)器 1 - 二進(jìn)制計數(shù)器最簡單的計數(shù)器可以使用幾行 Verilog 構(gòu)建快速高效的二進(jìn)制計數(shù)器。例如，下面是一個 32 位計數(shù)器。reg [31:0] cnt;always @(posedge clk) cnt <= cnt+1;此類計數(shù)器從 0 計數(shù)到 4294967295，然后回滾 0 以繼續(xù)其進(jìn)程。它占用的資源很少，并且在FPGA中運(yùn)行速度快，這要?dú)w功于隱藏的攜帶鏈（稍后會詳細(xì)介紹）。現(xiàn)在，讓我們看看一些變化。首先
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實現(xiàn)最高效的數(shù)據(jù)轉(zhuǎn)換：深入了解Achronix JESD204C解決方案

長期以來，Achronix為不同行業(yè)的數(shù)據(jù)密集型和高帶寬應(yīng)用提供了創(chuàng)新性的FPGA產(chǎn)品和技術(shù)，并幫助客戶不斷打破性能極限。其中一些應(yīng)用需要與先進(jìn)的模擬/數(shù)字轉(zhuǎn)換器（ADC）和數(shù)字/模擬轉(zhuǎn)換器（DAC）進(jìn)行對接——可由JESD204C完美地完成這項任務(wù)。JESD204B/C是由JEDEC定義和開發(fā)的高速數(shù)據(jù)轉(zhuǎn)換器串行接口標(biāo)準(zhǔn)。該標(biāo)準(zhǔn)減少了高速數(shù)據(jù)轉(zhuǎn)換器和其他高性能器件（如Achronix Speedster7t FPGA）之間的數(shù)據(jù)輸入和輸出數(shù)量。這種數(shù)字和模擬信號鏈的組合使設(shè)計人員能夠獲得簡化的小尺寸電路
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萊迪思即將舉辦網(wǎng)絡(luò)研討會探討全新推出的創(chuàng)新中端FPGA

萊迪思半導(dǎo)體，低功耗可編程器件的領(lǐng)先供應(yīng)商，近日宣布將舉辦一場網(wǎng)絡(luò)研討會，介紹其最新的兩款創(chuàng)新型中端FPGA器件系列，萊迪思Avant?-G和Avant?-X，分別為通用FPGA和高級互連FPGA。在網(wǎng)絡(luò)研討會上，萊迪思將介紹這些新型FPGA相關(guān)的技術(shù)，新產(chǎn)品旨在為通信、計算、工業(yè)和汽車市場的中端應(yīng)用提供低功耗、先進(jìn)的連接和優(yōu)化的計算能力等特性。●? ?主辦方：萊迪思半導(dǎo)體●? ?內(nèi)容：萊迪思最新推出的中端FPGA——Avant-G和Avant-X●? &
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跨越時鐘域

FPGA設(shè)計可以使用多個時鐘。每個時鐘在FPGA內(nèi)部形成一個“時鐘域”，如果在另一個時鐘域中需要在一個時鐘域中生成的信號，則需要格外小心?？鐣r鐘域1-信號假設(shè) clkB 域中需要來自 clkA 域的信號。它需要“同步”到 clkB 域，因此我們要構(gòu)建一個同步器設(shè)計，它從 clkA 域獲取一個信號，并在 clkB 域中創(chuàng)建一個新信號。在第一種設(shè)計中，我們假設(shè)與 clkA 和 clkB 時鐘速度相比，“信號輸入”變化緩慢。您需要做的就是使用兩個觸發(fā)器將信號從 clkA 移動到 clkB。module Sig
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用FPGA邏輯消抖動

我們將一個開關(guān)連接到FPGA上，連接方式如下圖：機(jī)械開關(guān)的問題就是有抖動，每次按一下開關(guān)，你會得到下面的信號：這種信號很少碰到，多數(shù)情況是下面的這種：我們可以用FPGA的計數(shù)器來記錄按鍵的次數(shù)，并通過數(shù)碼管顯示出來：上電的時候，一起是好的：如果按十次鍵，得到下面的結(jié)果：顯然不對。那如何解決呢？一種方式是添加一個R/C濾波器，再跟一個施密特觸發(fā)器之后送給FPGA，當(dāng)然還有更簡單的方式，就是在FPGA內(nèi)部進(jìn)行消抖動。 FPGA擅長簡單的運(yùn)算，讓我們使用FPGA中的計數(shù)器來查看按下或釋放按鈕的時間。只有當(dāng)計
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用FPGA做正交解碼

FPGA非常適合用邏輯來實現(xiàn)正交解碼的功能。什么是正交信號？正交信號是兩個相位差為90度的信號。它們在機(jī)械系統(tǒng)中用于確定軸的運(yùn)動（或旋轉(zhuǎn)）。這是一個向前移動幾步的軸。如果對脈沖計數(shù)，則可以說軸移動了3步。如果計算邊緣，則可以說軸移動了12步。這就是我們在此頁面上所做的?，F(xiàn)在，軸向后移動了相同的量。因此，想法是通過查看邊緣和水平，我們可以確定運(yùn)動的方向和距離。這是一個示例，其中軸向前移動10步，然后向后移動7步。它們在哪里使用？在機(jī)械手軸中，用于反饋控制。用旋鈕確定用戶輸入。在電腦鼠標(biāo)中，確定運(yùn)動方向。如果
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文本LCD模塊的控制FPGA

文本LCD模塊便宜且易于使用微控制器或FPGA進(jìn)行接口。這是一個1行x 16個字符的模塊：要控制LCD模塊，您需要11個IO引腳來驅(qū)動8位數(shù)據(jù)總線和3個控制信號。3個控制信號是：E：啟用或“ LCD選擇”。高活躍。讀/寫：讀/寫。0寫入，1讀取。RS：寄存器選擇，0表示命令字節(jié)，1表示數(shù)據(jù)字節(jié)。大多數(shù)LCD模塊都基于HD44780芯片或是兼容的。查閱Wikipedia以獲取更多信息。7位設(shè)計讓我們用FPGA板驅(qū)動LCD模塊。這是我們設(shè)計的框圖：Pluto從PC串行端口接收數(shù)據(jù)，對其進(jìn)行反序列化，然后將其發(fā)
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R/C伺服電機(jī)FPGA

FPGA適用于控制R / C伺服電機(jī)。什么是遙控伺服器？R / C伺服（“遙控伺服電機(jī)”）由一個電機(jī)，一些電子設(shè)備和一組裝在一個小盒子中的齒輪組成。單軸從伺服器出來。您可以通過向伺服器發(fā)送脈沖來精確控制軸的旋轉(zhuǎn)角度。軸旋轉(zhuǎn)角度限制為大約270度（它不能旋轉(zhuǎn)一整圈，而只能旋轉(zhuǎn)3/4圈）。這是一個伺服器的圖片（已被咬住，但已說明了我們的目的）。有用的信息鏈接包括：RC伺服控制RC飛機(jī)伺服系統(tǒng)使用指南遙控伺服器101R / C Servos用于：在遙控模型中（汽車，飛機(jī)…）。在機(jī)器人技術(shù)中。電氣連接
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DRAM / NAND 巨頭明年加碼半導(dǎo)體投資：三星增加 25%、SK 海力士增加 100%

IT之家 12 月 21 日消息，根據(jù)韓媒 ETNews 報道，三星和 SK 海力士都計劃 2024 年增加半導(dǎo)體設(shè)備投資。三星計劃投資 27 萬億韓元（IT之家備注：當(dāng)前約 1482.3 億元人民幣），比 2023 年投資預(yù)算增加 25%；而 SK 海力士計劃投資 5.3 萬億韓元（當(dāng)前約 290.97 億元人民幣），比今年的投資額增長 100%。報道中指出，三星和 SK 海力士在增加半導(dǎo)體設(shè)備投資之外，還提高了 2024 年的產(chǎn)能目標(biāo)。報道稱三星將 DRAM 和 NAND
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使用Verilog來編程FPGA

FPGA是依賴數(shù)字邏輯的數(shù)字器件，計算機(jī)硬件使用的是數(shù)字邏輯，每一個計算，屏幕上每一個像素的呈現(xiàn)，音樂軌的每一個note都是使用數(shù)字邏輯構(gòu)成的功能塊來實現(xiàn)的。雖然多數(shù)時候，數(shù)字邏輯是抽象的數(shù)學(xué)概念，而不是物理電子，邏輯門以及其它的數(shù)字邏輯器件則是由刻蝕在集成電路上的晶體管來實現(xiàn)的。對于FPGA來講，可以通過繪制邏輯門構(gòu)成的電路，將這些門映射到FPGA的通用門上，并將它們連接起來以實現(xiàn)你設(shè)想的邏輯設(shè)計。另外一種方式是，使用Verilog（或其它的）硬件描述語言來實現(xiàn)邏輯。你依然可以購買能夠?qū)崿F(xiàn)小數(shù)量邏
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集邦咨詢稱 2024Q1 手機(jī) DRAM、eMMC / UFS 均價環(huán)比增長 18-23%

IT之家 12 月 20 日消息，集邦咨詢近日發(fā)布報告，預(yù)估 2024 年第 1 季度 Mobile DRAM 及 NAND Flash（eMMC / UFS）環(huán)比增長 18-23%，而且不排除進(jìn)一步拉高的情況。集邦咨詢表示 2024 年第 1 季中國智能手機(jī) OEM 的生產(chǎn)規(guī)劃依然穩(wěn)健，由于存儲器價格漲勢明確，帶動買方積極擴(kuò)大購貨需求，以建設(shè)安全且相對低價的庫存水位。集邦咨詢認(rèn)為買賣雙方庫存降低，加上原廠減產(chǎn)效應(yīng)作用，這兩大因素促成這一波智能手機(jī)存儲器價格的強(qiáng)勁漲勢。集邦咨詢認(rèn)為明年第 1 季
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