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        EEPW首頁 >> 主題列表 >> dp-cpld

        分析CPLD與FPGA區(qū)別

        • 可編程邏輯器件主要包括FPGA和CPLD,F(xiàn)PGA是Field Programmable Gate Array縮寫,CPLD是Complex Promrammable Logic Device的縮寫。隨著芯片技術(shù)的發(fā)展,CPLD和FPGA的概念已經(jīng)模糊在一起,如Altera和Lattice公司把小容
        • 關(guān)鍵字: CPLD  FPGA  分析    

        PROFIBUS-DP現(xiàn)場(chǎng)總線技術(shù)在磨床改造中的應(yīng)用

        • 0 引言寶鋼2050 熱軋磨輥車間裝備的數(shù)控軋輥磨床是1988 年從德國WALDR ICH SIEGEN公司引進(jìn)的。使用至今其控制系統(tǒng)各部件已逐步老化, 不僅故障率高而且性能下降,已經(jīng)嚴(yán)重影響了軋輥的磨削精度和磨削效率。為了更好地
        • 關(guān)鍵字: PROFIBUS-DP  現(xiàn)場(chǎng)總線技術(shù)  磨床  中的應(yīng)用    

        Profibus-DP現(xiàn)場(chǎng)總線技術(shù)在水電廠監(jiān)控中的應(yīng)用

        • 1 現(xiàn)場(chǎng)總線技術(shù)概述現(xiàn)場(chǎng)總線是安裝在生產(chǎn)過程區(qū)域的現(xiàn)場(chǎng)設(shè)備/儀表與控制室內(nèi)的自動(dòng)控制裝置/系統(tǒng)之間的一種串行、數(shù)字式、多點(diǎn)、雙向通信的數(shù)據(jù)總線。其中“生產(chǎn)過程”包括斷續(xù)生產(chǎn)過程和連續(xù)生產(chǎn)過程兩類
        • 關(guān)鍵字: Profibus-DP  現(xiàn)場(chǎng)總線技術(shù)  水電廠  監(jiān)控    

        基于CPLD的多路溫度采集系統(tǒng)電路及設(shè)計(jì)方案

        • 摘要 應(yīng)用溫度采集芯片MAX6675,將其與K型熱電偶結(jié)合,利用CPLD對(duì)其進(jìn)行控制,實(shí)現(xiàn)一個(gè)多路溫度采集系統(tǒng)。文中介紹了系統(tǒng)的硬件電路結(jié)構(gòu),并根據(jù)芯片的內(nèi)部時(shí)序介紹了CPLD內(nèi)部邏輯電路的設(shè)計(jì)。通過兩種溫度環(huán)境下的系
        • 關(guān)鍵字: CPLD  多路  電路  溫度采集系統(tǒng)    

        Verilog HDL語言在FPGA/CPLD開發(fā)中的應(yīng)用

        • 1 引言近30年來,由于微電子學(xué)和計(jì)算機(jī)科學(xué)的迅速發(fā)展,給EDA(電子設(shè)計(jì)自動(dòng)化)行業(yè)帶來了巨大的變化。特別是進(jìn)入20世紀(jì)90年代后,電子系統(tǒng)已經(jīng)從電路板級(jí)系統(tǒng)集成發(fā)展成為包括ASIC、FPGA和嵌入系統(tǒng)的多種模式??梢哉f
        • 關(guān)鍵字: Verilog  FPGA  CPLD  HDL    

        基于CPLD的MAX1032采樣控制的實(shí)現(xiàn)

        • 基于CPLD的MAX1032采樣控制的實(shí)現(xiàn),0 引言本文主要介紹MAX1032采樣芯片以及使用CPLD對(duì)MAX1032采樣進(jìn)行控制的方法。事實(shí)上,雖然微控制器也能對(duì)MAX1032進(jìn)行方便的控制,但使用CPLD來控制系統(tǒng)外圍設(shè)備,可以節(jié)省微控制器的資源,減輕其負(fù)擔(dān),同時(shí)可以讓其
        • 關(guān)鍵字: 控制  實(shí)現(xiàn)  采樣  MAX1032  CPLD  基于  

        XC9500系列CPLD遙控編程的實(shí)現(xiàn)

        • 摘 要: 簡(jiǎn)單介紹了XC9500系列CPLD器件及其系統(tǒng)內(nèi)編程(ISP)性能,接著講述了XC9500系列CPLD器件遙控編程的實(shí)現(xiàn)方法,并重點(diǎn)介紹了在遙控編程系統(tǒng)中應(yīng)用微控制器(lntel 8031)實(shí)現(xiàn)嵌入式ISP的軟硬件設(shè)計(jì)。關(guān)鍵詞: CPL
        • 關(guān)鍵字: 9500  CPLD  XC  遙控    

        FPGA與CPLD的比較

        • 盡管FPGA和CPLD都是可編程器件,有很多共同特點(diǎn),但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點(diǎn):1、CPLD更適合完成各種算法和組合邏輯,FPGA更適合于完成時(shí)序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適
        • 關(guān)鍵字: FPGA  CPLD  比較    

        基于CPLD與單片機(jī)的雙向通信控制器設(shè)計(jì)

        • 在傳統(tǒng)的控制系統(tǒng)中,人們常常采用單片機(jī)作為控制核心。但這種方法硬件連線復(fù)雜,可靠性差,且單片機(jī)的端口數(shù)目、內(nèi)部定時(shí)器和中斷源的個(gè)數(shù)都有限,在實(shí)際應(yīng)用中往往需要外加擴(kuò)展芯片。這無疑對(duì)系統(tǒng)的設(shè)計(jì)帶來諸多不
        • 關(guān)鍵字: 控制器  設(shè)計(jì)  通信  雙向  CPLD  單片機(jī)  基于  

        基于CPLD的MAX1032采樣控制的方法與實(shí)現(xiàn)

        • 基于CPLD的MAX1032采樣控制的方法與實(shí)現(xiàn), 引言
          本文主要介紹MAX1032采樣芯片以及使用CPLD對(duì)MAX1032采樣進(jìn)行控制的方法。事實(shí)上,雖然微控制器也能對(duì)MAX1032進(jìn)行方便的控制,但使用CPLD來控制系統(tǒng)外圍設(shè)備,可以節(jié)省微控制器的資源,減輕其負(fù)擔(dān),同時(shí)可
        • 關(guān)鍵字: 方法  實(shí)現(xiàn)  控制  采樣  CPLD  MAX1032  基于  

        PROFIBUS DP冗余總線在科遠(yuǎn)SY系列電動(dòng)執(zhí)行機(jī)構(gòu)中的應(yīng)用

        • 摘要:PROFIBUS現(xiàn)場(chǎng)總線是一種國際化、開放式、不依賴于設(shè)備生產(chǎn)商的現(xiàn)場(chǎng)總線標(biāo)準(zhǔn),在多種自動(dòng)化領(lǐng)域中占據(jù)主導(dǎo)...
        • 關(guān)鍵字: PROFIBUS-DP  冗余總線  電動(dòng)執(zhí)行機(jī)構(gòu)  

        PROFIBUS-DP現(xiàn)場(chǎng)總線在ZJ17高速卷煙機(jī)的應(yīng)用

        • 常德煙草機(jī)械有限責(zé)任公司是國家大二型機(jī)械制造企業(yè),隸屬于中國煙草機(jī)械集團(tuán),是煙草系統(tǒng)四家煙機(jī)制造企業(yè)之...
        • 關(guān)鍵字: PROFIBUS-DP  現(xiàn)場(chǎng)總線  高速卷煙機(jī)  

        現(xiàn)場(chǎng)總線Profibus-DP主從站數(shù)據(jù)交換探討

        采用CPLD的片內(nèi)環(huán)形振蕩器的方案設(shè)計(jì)

        • 采用CPLD的片內(nèi)環(huán)形振蕩器的方案設(shè)計(jì),本文介紹一種通用的基于CPLD的片內(nèi)振蕩器設(shè)計(jì)方法,它基于環(huán)形振蕩器原理,只占用片上普通邏輯資源(LE),無需使用專用邏輯資源(如MaxII中的UFM),從而提高了芯片的資源利用率;振蕩頻率可在一定范圍內(nèi)調(diào)整,振蕩輸出
        • 關(guān)鍵字: 方案設(shè)計(jì)  振蕩器  內(nèi)環(huán)  CPLD  采用  

        FPGA/CPLD設(shè)計(jì)思想與技巧簡(jiǎn)介

        • FPGA/CPLD設(shè)計(jì)思想與技巧簡(jiǎn)介,本文討論的四種常用FPGA/CPLD設(shè)計(jì)思想與技巧:乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化,都是FPGA/CPLD邏輯設(shè)計(jì)的內(nèi)在規(guī)律的體現(xiàn),合理地采用這些設(shè)計(jì)思想能在FPGA/CPLD設(shè)計(jì)工作中取得事半功倍的效果。  F
        • 關(guān)鍵字: 簡(jiǎn)介  技巧  設(shè)計(jì)思想  FPGA/CPLD  
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