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	rs編譯碼
        

        
	
        
    	
        
    	  	
        
              	
                                
        
                  

                                
        
                    
        基于歐氏算法的RS硬件解碼方案的FPGA實現(xiàn)
        
                                                            
          
                    	
        • 在通信系統(tǒng)中應(yīng)用廣泛。由于RS碼的譯碼復(fù)雜度高，數(shù)字運算量大，常見的硬件及軟件譯碼方案大多不能滿足高速率的傳輸需求，一般適用于10Mbps以下。本文提出的歐氏算法和頻譜結(jié)構(gòu)分析相結(jié)合的RS硬件解碼方案，適用于FPGA單片實現(xiàn)，速率高、延遲小、通用性強、使用靈活。筆者在FPGA芯片上實現(xiàn)了GF（2 8）上符號速率為50Mbps的流式解碼方案，最大延時為640ns，參數(shù)可以根據(jù)需要靈活設(shè)置。
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        • 關(guān)鍵字：
                        RS編譯碼  差錯控制編碼技術(shù)  FPGA                          
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        基于FPGA的RS(255，239)編譯碼器
        
                                                            
          
                    	
        • 摘要  RS(Reed—Solomon)編碼是一種具有較強糾錯能力的多進(jìn)制BCH編碼，其既可糾正隨機錯誤，又可糾正突發(fā)錯誤。RS編譯碼器廣泛應(yīng)用于通信和存儲系統(tǒng)，為解決高速存儲器中數(shù)據(jù)可靠性的問題，文中提出了RS編碼的實
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        • 關(guān)鍵字：
                        RS編譯碼  伽羅華域  BM算法  Chien搜索  Forney算法                          
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        基于FPGA的RS(255，239)編譯碼器設(shè)計及實現(xiàn)方法
        
                                                            
          
                    	
        •  RS(Reed—Solomon)編碼是一種具有較強糾錯能力的多進(jìn)制BCH編碼，其既可糾正隨機錯誤，又可糾正突發(fā)錯誤。RS編譯碼器廣泛應(yīng)用于通信和存儲系統(tǒng)，為解決高速存儲器中數(shù)據(jù)可靠性的問題，文中提出了RS編碼的實現(xiàn)方
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        • 關(guān)鍵字：
                        RS編譯碼    FPGA    伽羅華域    BM算法    Chien搜索                          
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	共3條
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        rs編譯碼介紹
        
      			
        
		      	
        
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