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EEPW首頁 >> 主題列表 >> 最小化互連延遲

最小化互連延遲文章進(jìn)入最小化互連延遲技術(shù)社區(qū)

通過物理綜合與優(yōu)化提升設(shè)計(jì)性能

邏輯優(yōu)化、邏輯布局和最小化互連延遲都是實(shí)現(xiàn)最大性能的重要工作。時(shí)序驅(qū)動(dòng)綜合技術(shù)對(duì)設(shè)計(jì)性能提供了重大改進(jìn)。影響時(shí)序驅(qū)動(dòng)綜合的限制因素是估計(jì)布線延遲的精度。
關(guān)鍵字：物理綜合最小化互連延遲 Virtex

共1條 1/1 1

最小化互連延遲介紹

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