時序設計 文章 進入時序設計技術(shù)社區(qū)
5G網(wǎng)絡的時序設計和管理同步方式
- 隨著網(wǎng)絡從使用基于頻分雙工（FDD）的通信鏈路發(fā)展到使用時分雙工（TDD），不僅出現(xiàn)了頻率方面的需求，同時還產(chǎn)生了對精確相位和時間同步的需求。運營商在TDD網(wǎng)絡中部署的設備依賴于GNSS、同步以太網(wǎng)（SyncE）和IEEE-1588精確時間協(xié)議（PTP）的組合，以在整個網(wǎng)絡中提供準確的頻率、相位和時間。 第三代合作伙伴計劃（3GPP）第15版中引入了全新的5G RAN架構(gòu)，此架構(gòu)將基帶單元（BBU）和遠程無線電頭端（RRH）拆分為集中式單元（CU）、分布式單元（DU）和無線電單元（RU）。這種
- 關(guān)鍵字： 5G網(wǎng)絡 時序設計
基于邏輯組的快速宏布局方法
- 本文介紹了一種適用于高宏數(shù)、難時序設計的快速平面布局方法。微捷碼 Talus 可基于邏輯組產(chǎn)生所有宏和標準單元的快速布局。我們可通過利用這種布局信息來突出并劃分適合的“宏組”，對于高宏數(shù)設計來說，這種方法要較一般的分組方法更快速更合理。對于時序關(guān)鍵設計，我們可使用積極的“宏布局”方法來顯示關(guān)鍵邏輯組，然后再通過增量（incremental）的“宏布局”來調(diào)整布局形狀（無宏或其它邏輯組阻塞的前提下將關(guān)鍵邏輯聚集在一起）；這種方法可為我們常規(guī)設計帶好更好時序（包括 WNS/TNS）和更好布線結(jié)果（總線長）。
- 關(guān)鍵字： 時序設計 快速平面布局 微捷碼
基于FPGA的帶Cache的嵌入式CPU的設計與實現(xiàn)
- MIPS(Microprocessor without Interlocked Pipeline STages)是一種典型的RISC(Reduced InstructiON Set Computer)微處理器,在嵌入式系統(tǒng)領域中得到廣泛的應用。MIPS32TM指令集開放，指令格式規(guī)整，易于流水線設計，大量使用寄存器操作。與CISC(Complex Instruction Set Computer)微處理器相比，RISC具有設計更簡單、設計周期更短等優(yōu)點，并可以應用更多先進的技術(shù)，開發(fā)更快的下一代處理器。
- 關(guān)鍵字： 流水線CPU 時序設計 FPGA
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