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VHDL結(jié)構(gòu)體的結(jié)構(gòu)化描述法
- 在結(jié)構(gòu)體中，設(shè)計(jì)任務(wù)的程序包內(nèi)定義了一個(gè)8輸入與門（and8）和一個(gè)二異或非門（xnor2）。把該程序包編譯到庫中，可通過USE從句來調(diào)用這些元件，并從work庫中的gatespkg程序包里獲取標(biāo)準(zhǔn)化元件。
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VHDL結(jié)構(gòu)體的數(shù)據(jù)流描述法
- 據(jù)流描述（dataflow description）是結(jié)構(gòu)體描述方法之一，它描述了數(shù)據(jù)流程的運(yùn)動(dòng)路徑、運(yùn)動(dòng)方向和運(yùn)動(dòng)結(jié)果。例如，同樣是一個(gè)8位比較器采用數(shù)據(jù)流法編程
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