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        EEPW首頁 >> 主題列表 >> 多時鐘域

        FPGA中的多時鐘域設計

        • FPGA中的多時鐘域設計-在一個SOC設計中,存在多個、獨立的時鐘,這已經是一件很平常的事情了。大多數的SOC器件都具有很多個接口,各個接口標準都可能會使用完全不同的時鐘頻率。
        • 關鍵字: FPGA  多時鐘域  

        多時鐘域數據傳遞的Spartan-II FPGA實現

        • 本文采用FPGA來設計一款廣泛應用于計算機、Modem、數據終端以及許多其他數字設備之間的數據傳輸的專用異步并行通信接口芯片,實現了某一時鐘域(如66 MHz)的8位并行數據到另一低時鐘域(如40 MHz)16位并行數據的異步轉換,并且客戶可以根據自己的要求進行數據定義。完成數據在不同時鐘域間的正確傳遞的同時防止亞穩(wěn)態(tài)的出現,保持系統的穩(wěn)定,是電路設計的關鍵。
        • 關鍵字: Spartan-II  FPGA  多時鐘域  數據    
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        多時鐘域介紹

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