復(fù)雜性 文章 進入復(fù)雜性技術(shù)社區(qū)
通過左移DRC設(shè)計規(guī)則檢查方法降低IC設(shè)計復(fù)雜性
- 最成功的半導(dǎo)體公司都知道，集成電路 （IC） 設(shè)計日益復(fù)雜，這讓我們的傳統(tǒng)設(shè)計規(guī)則檢查 （DRC） 方法不堪重負。迭代的“通過校正構(gòu)建”方法適用于更簡單的自定義布局，但現(xiàn)在卻造成了大量的運行時和資源瓶頸，阻礙了設(shè)計團隊有效驗證其高級設(shè)計和滿足緊迫的上市時間目標的能力。為了克服這種設(shè)計復(fù)雜性，主要半導(dǎo)體公司不斷從其生態(tài)系統(tǒng)合作伙伴那里尋找有效的工具。西門子 EDA 是一家大型電子設(shè)計自動化 （EDA） 公司，它提供了一種新的、強大的左移驗證策略，他們對其進行了評估并宣布它改變了他們早期設(shè)計階段的游
- 關(guān)鍵字： 左移DRC 設(shè)計規(guī)則 IC設(shè)計 復(fù)雜性
SoC設(shè)計：復(fù)雜性為驗證提出更高要求
- 由于片上系統(tǒng)(SoC)設(shè)計變得越來越復(fù)雜，驗證面臨著巨大的挑戰(zhàn)。大型團隊不斷利用更多資源來尋求最高效的方法，從而將新的方法學(xué)與驗證整合在一起，并最終將設(shè)計與驗證整合在一起。雖然我們知道實現(xiàn)驗證計劃幾乎占去了整個芯片設(shè)計工作的2/3，但是我們還是發(fā)現(xiàn)有團隊遲交芯片，錯過計劃的流片最終期限。這種疏忽可能造成嚴重的商業(yè)后果，因為這意味著硬件和軟件錯誤經(jīng)常被遺漏，直到設(shè)計周期的晚期。 為了創(chuàng)建一個全面的驗證解決方案，我們首先必須認識到設(shè)計工程師和驗證工程師所面臨的分歧和挑戰(zhàn)。在這個過程中，我們發(fā)現(xiàn)某些
- 關(guān)鍵字： 嵌入式系統(tǒng) 單片機 SoC 復(fù)雜性 片上系統(tǒng) SoC ASIC
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復(fù)雜性介紹
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