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        基于ADSP-BF533處理器的去方塊濾波器的實(shí)現(xiàn)及優(yōu)化

        作者: 時間:2008-03-20 來源:網(wǎng)絡(luò) 收藏
        優(yōu)化實(shí)現(xiàn)的去方塊濾波模塊,基于原有的H.264解碼器上對一個25幀約400 kbit/s的圖像序列進(jìn)行濾波,大概需要250 MHz的時鐘周期,而解碼器的總周期約為700 MHz的時鐘周期,從而使得解碼器的解碼速度達(dá)到約20幀/s,基本達(dá)到準(zhǔn)實(shí)時解碼的要求。

          該實(shí)現(xiàn)方法相對于參考模塊進(jìn)行了較好的優(yōu)化,但通過對程序進(jìn)行耗時分析,在讀取待濾波數(shù)據(jù)和重新寫入已濾波的數(shù)據(jù),獲取BS值的GetBs函數(shù)和進(jìn)行濾波的EdgeLoop函數(shù)方面都還有進(jìn)一步提升的空間。對于片外片內(nèi)數(shù)據(jù)的交互可以采用DMA技術(shù),在濾波的同時進(jìn)行數(shù)據(jù)讀寫,從而抵消數(shù)據(jù)搬移消耗的時鐘周期;對于GetBs和EdgeLoop中的匯編代碼實(shí)現(xiàn)效率還有進(jìn)一步改進(jìn)的空間;這兩方面也是下一步的改進(jìn)方向。


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