微機(jī)保護(hù)控制接口的CPLD抗干擾設(shè)計(jì)
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圖1 繼電保護(hù)控制出口原理
因此，繼電保護(hù)控制出口的閉鎖和冗余度設(shè)計(jì)是防止控制出口誤動(dòng)的關(guān)鍵所在。嚴(yán)格監(jiān)視分合閘多重命令的執(zhí)行順序，不允許無(wú)序分合閘命令通過(guò)，是防止控制出口誤動(dòng)的根本措施。分合閘多重命令的有序執(zhí)行，可以看作一個(gè)狀態(tài)變化序列，用CPLD狀態(tài)機(jī)對(duì)這個(gè)狀態(tài)序列進(jìn)行監(jiān)控，就能杜絕無(wú)序狀態(tài)的通過(guò)，實(shí)現(xiàn)控制出口的無(wú)干擾控制。
基于CPLD狀態(tài)機(jī)的抗干擾控制接口設(shè)計(jì)
設(shè)計(jì)一個(gè)基于DSP的高壓開關(guān)柜微機(jī)綜合保護(hù)系統(tǒng)時(shí)，用一片CPLD芯片實(shí)現(xiàn)圖1所示的I/O接口，并設(shè)計(jì)一個(gè)有限狀態(tài)機(jī)，對(duì)狀態(tài)輸入I1，I2，I3進(jìn)行監(jiān)控，狀態(tài)機(jī)輸出作為總分合閘命令的允許和禁止信號(hào)?；贑PLD的微機(jī)保護(hù)控制接口如圖2 所示。
圖2 微機(jī)保護(hù)的CPLD控制接口
分合閘多重命令的狀態(tài)編碼
狀態(tài)機(jī)有3位二進(jìn)制輸入，共有23=8種狀態(tài)。采用二進(jìn)制編碼方式(Binary coded)將控制接口的初始狀態(tài)S0到所有可能的狀態(tài)變遷，列成一張編碼表，如表1 所示。狀態(tài)編碼表是編寫VHDL程序的基礎(chǔ)。
表1 微機(jī)保護(hù)控制接口狀態(tài)機(jī)編碼表
狀態(tài)機(jī)設(shè)計(jì)
狀態(tài)機(jī)的時(shí)鐘頻率為5MHz。復(fù)位信號(hào)/Reset來(lái)自DSP微機(jī)保護(hù)裝置的系統(tǒng)復(fù)位信號(hào)，對(duì)狀態(tài)機(jī)的狀態(tài)初始化。
評(píng)論