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        24位Σ-Δ ADC簡化ECG/EKG模擬前端設計

        作者: 時間:2013-09-28 來源:網(wǎng)絡 收藏
        進一步抑制。

          4、低通/抗混疊濾波器

          低通濾波器用來抑制高頻干擾,它也作為一個抗混疊濾波器(即阻止任何大于奈奎斯特或1 / 2采樣頻率的信號,避免產(chǎn)生混疊)。

          為了進一步降低輸入共模信號,ECG設計通常還引入一級“右腿驅(qū)動器”,驅(qū)動反相共模信號返回人體。為了確保病人的安全,通常利用一個運算放大器和一個限流電阻,確保驅(qū)動到人體的是一個非常微弱的信號源。這個屏蔽裝置旨在降低ECG探頭承載信號的噪聲耦合。

          總之,ECG應用中的有用信號小于100mV,考慮到失調(diào)和共模信號,通常將其放大到2V。因此,AFE必須有2V測量范圍,可以辨識低于幾百,甚至幾十μV的信號,采樣率在1ksps左右。

          正確的可以減少、甚至消除對AFE的需求

          AFE設計完成后,能夠滿足實際應用對分辨率、速率和輸入量程的要求的有許多。但是,仍要優(yōu)先考慮具有高分辨率、高共模抑制比(CMRR)及其它優(yōu)勢的ADC,以確保ECG的設計需求。

          MAX11040K同步采樣、ADC本身的性能指標即超出了此類應用的最低要求,可以取代系統(tǒng)的大部分功能電路,甚至可以省去AFE,提供了一種更可靠、更小封裝、更簡便的設計方案。

          MAX11040K具備才應用的幾項必備規(guī)格:

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計輸入量程:±2.2V

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計差分輸入

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計110dB共模抑制比(典型值)

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計分辨率:

           SNR >110dB

           19位無噪聲范圍

           有效分辨率 = 2/219 = 3.8μV

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計±6V輸入過壓保護

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計四路全差分同步采樣ADC

           可級聯(lián)多達32個通道同步采樣

          24位Σ-Δ ADC簡化ECG/EKG模擬前端設計可編程輸出數(shù)據(jù)速率

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        關鍵詞: 24位 Σ-Δ ADC ECG/EKG 模擬前端

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