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ADI實(shí)驗(yàn)室電路:完整的HART兼容型4mA至20mA解決方案（一）

作者：時(shí)間：2013-12-14 來(lái)源：網(wǎng)絡(luò)

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接至AVDD的電容可用于抵消濾波器輸出端因壓擺時(shí)間過(guò)快而導(dǎo)致的峰值電壓增加。然而，選擇此值時(shí)必須小心，因?yàn)樗鼤?huì)影響“確定外部元件值”部分討論的低通濾波器截止頻率。

圖10顯示了壓擺率控制設(shè)置改為SR時(shí)鐘= 5、SR階躍= 2且C1電容值保持4.7 nF不變的結(jié)果。這樣，轉(zhuǎn)換時(shí)間就會(huì)在240 ms左右。濾波器輸出端的峰值幅度可通過(guò)增加C1值、配置更慢的壓擺率或通過(guò)兩者的組合來(lái)進(jìn)一步降低。

ADI實(shí)驗(yàn)室電路:完整的HART兼容型4mA至20mA解決方案（一）

圖10. AD5422輸出（通道1）和HART濾波器輸出（通道2），SR時(shí)鐘= 5，SR階躍= 2，C1 = 4.7 nF，C2 = NC

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