基于FPGA數(shù)據(jù)流控制動態(tài)可重構(gòu)的實現(xiàn)
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基本遺傳算法是通過某種編碼機制把對象抽象為由特定符號按一定順序排成的串，就像染色體都是由基因排成的串，此處是使用二進制編碼，得到的是5 bit二進制字符串。程序如下：
2 FPGA基本結(jié)構(gòu)
目前主流FPGA均采用基于SRAM工藝的查找表結(jié)構(gòu)，也有些軍品和宇航級FPGA，采用Flash或熔絲與反熔絲工藝的查找表結(jié)構(gòu)。通過燒寫文件改變查找表內(nèi)容的方法來實現(xiàn)對FPGA的重復配置。
查找表(Look-Up-Table)簡稱為LUT，目前FPGA中多使用4輸入的LUT，所以每個LUT可以看成一個有4位地址線的RAM。這樣，每輸入一個信號進行邏輯運算就等于輸入一個地址進行查表，找出地址對應的內(nèi)容，然后輸出。
2．1 多路復用器(Multiplexer)
基于這種4輸入LUT結(jié)構(gòu)的原理，采用了4輸入的復用選擇器，在多路數(shù)據(jù)傳送過程中，能夠根據(jù)需要將其中任意一路選出，也稱多路選擇器或多路開關(guān)。本文將控制器產(chǎn)生的5位數(shù)據(jù)流通過移位寄存器來控制4個輸入端口的選擇，如圖3所示。本文引用地址：http://www.antipu.com.cn/article/191232.htm
2．2 移位寄存器(Shift Register)
在數(shù)字電路中，通常會用寄存器存放二進制數(shù)據(jù)或代碼，如圖4所示。Mux的選擇位由控制器產(chǎn)生的數(shù)據(jù)流經(jīng)緩存后輸出，SelA[1，0]，SelB[1，O]分別作用于兩個多路復用器。移位寄存器中輸出控制多路復用器的控制位如表1所示。
2．3 與非門
與非門是組成各種電路的基礎(chǔ)門，可根據(jù)需要，用與非門搭建不同的門，如圖5所示，將不同的與非門結(jié)構(gòu)實現(xiàn)與門或門等其他功能，實現(xiàn)動態(tài)可重構(gòu)。
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