圖6為差分調(diào)制系統(tǒng)的Simulink頂層模型，整個(gè)模型具有三個(gè)輸入端口，在圖中做出標(biāo)記的為數(shù)據(jù)輸入端口，經(jīng)過(guò)頻率交織子系統(tǒng)處理的QPSK碼流通過(guò)這個(gè)端口輸入差分調(diào)制子系統(tǒng)。其余兩個(gè)端口輸入的為系統(tǒng)時(shí)鐘信息。其中，一個(gè)為系統(tǒng)時(shí)鐘框架中的幀同步時(shí)鐘，另一個(gè)

為系統(tǒng)時(shí)鐘框架中的粗同步信號(hào)指示時(shí)鐘。基于這兩個(gè)系統(tǒng)時(shí)鐘信號(hào)，相關(guān)的計(jì)算單元計(jì)算產(chǎn)生差分調(diào)制系統(tǒng)的本地時(shí)鐘，并進(jìn)一步得到相關(guān)模塊的控制時(shí)序。

本地存儲(chǔ)單元為一個(gè)深度為384存儲(chǔ)單元的單端口只讀存儲(chǔ)器，本地存儲(chǔ)單元中存放著事先計(jì)算得到的編碼相位參考符號(hào)，在控制時(shí)序的控制下，差分調(diào)制系統(tǒng)在每幀信號(hào)的幀頭適時(shí)地從本地存儲(chǔ)單元中讀出相位參考符號(hào)，并將其放入反饋緩沖區(qū)中，為幀結(jié)構(gòu)整合以及差分調(diào)制做準(zhǔn)備。反饋緩沖區(qū)為一個(gè)移位寄存器，它將為輸入的幀符號(hào)流提供差分調(diào)制的基準(zhǔn)符號(hào)差分調(diào)制將由編碼QPSK符號(hào)流的模8相加計(jì)算實(shí)現(xiàn)，為了增強(qiáng)系統(tǒng)的穩(wěn)定性，使用加法模塊與一個(gè)查找表實(shí)現(xiàn)模8相加計(jì)算。從圖6中可以清楚地看到，經(jīng)過(guò)差分調(diào)制的碼流通過(guò)反饋回路引入復(fù)用模塊，在嚴(yán)格的時(shí)序控制下參與后續(xù)碼流的差分調(diào)制。

4 DAB信號(hào)調(diào)制系統(tǒng)的實(shí)際測(cè)試

利用Xilinx公司的System Generator軟件將在Simulink平臺(tái)中經(jīng)過(guò)仿真驗(yàn)證的DAB信號(hào)調(diào)制系統(tǒng)硬件模型自動(dòng)轉(zhuǎn)換為可實(shí)現(xiàn)在FPGA芯片中的硬件工程。所選用的FPGA芯片為Xilinx公司的Virtex 6系列，型號(hào)為xc6vlx240t-1fff1156。