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        Cadence PCB設(shè)計(jì)使用筆記

        作者: 時(shí)間:2012-08-06 來源:網(wǎng)絡(luò) 收藏


        三、Allegro的屬性設(shè)定
        Allegro界面介紹:
        Option(選項(xiàng)):顯示正在使用的命令。
        Find(選?。?
        Design Object Find Filter選項(xiàng):
        Groups(將1個(gè)或多個(gè)元件設(shè)定為同一組群)
        Comps(帶有元件序號的Allegro元件)
        Symbols(所有電路板中的Allegro元件)
        Functions(一組元件中的一個(gè)元件)
        Nets(一條導(dǎo)線)
        Pins(元件的管腳)
        Vias(過孔或貫穿孔)
        Clines(具有電氣特性的線段:導(dǎo)線到導(dǎo)線;導(dǎo)線到過孔;過孔到過孔)
        Lines(具有電氣特性的線段:如元件外框)
        Shapes(任意多邊形)
        Voids(任意多邊形的挖空部分)
        Cline Segs(在clines中一條沒有拐彎的導(dǎo)線)
        Other Segs(在line中一條沒有拐彎的導(dǎo)線)
        Figures(圖形符號)
        DRC errors(違反設(shè)計(jì)規(guī)則的位置及相關(guān)信息)
        Text(文字)
        Ratsnets(飛線)
        Rat Ts(T型飛線)
        Find By Name選項(xiàng)
        類型選擇:Net網(wǎng)絡(luò);Symbol符號;Devtype設(shè)備類型;Property屬性;Group分組
        類別選擇:Name(在左下角填入)元件名稱;List列表;Objecttype
        Visiblity(層面顯示)
        View欄
        Conductors欄:針對所有走線層做開和關(guān)
        Planes欄:針對所有電源/地層做開和關(guān)
        Etch欄:走線
        Pin欄:元件管腳
        Via欄:過孔
        Drc欄:錯(cuò)誤標(biāo)示
        All欄:所有層面和標(biāo)示
        定制Allegro環(huán)境
        文件類型:
        .brd(普通的電路板文件)
        .dra(Symbols或Pad的可編輯保存文件)
        .pad(Padstack文件,在做symbol時(shí)可以直接調(diào)用)
        .psm(Library文件,保存一般元件)
        .osm(Library文件,保存由圖框及圖文件說明組成的元件)
        .bsm(Library文件,保存由板外框及螺絲孔組成的元件)
        .fsm(Library文件,保存特殊圖形元件,僅用于建立Padstack的Thermal Relief)
        .ssm(Library文件,保存特殊外形元件,僅用于建立特殊外形的Padstack)
        .mdd(Library文件,保存module definition)
        .tap(輸出的包含NC drill數(shù)據(jù)的文件)
        .scr(Script和macro文件)
        .art(輸出底片文件)
        .log(輸出的一些臨時(shí)信息文件)
        .color(view層面切換文件)
        .jrl(記錄操作Allegro的事件的文件)
        設(shè)定Drawing Size(setupDrawing size....)
        設(shè)定Drawing Options(setupDrawing option....)
        status:on-line DRC(隨時(shí)執(zhí)行DRC)
        Default symbol height
        Display:
        Enhanced Display Mode:
        Display drill holes:顯示鉆孔的實(shí)際大小
        Filled pads:將via 和pin由中空改為填滿
        Cline endcaps:導(dǎo)線拐彎處的平滑
        Thermal pads:顯示Negative Layer的pin/via的散熱十字孔
        設(shè)定Text Size(setupText Size....)
        設(shè)定格子(setup grids...)
        Grids on:顯示格子
        Non-Etch:非走線層
        All Etch:走線層
        Top:頂層
        Bottom:底層
        設(shè)定Subclasses選項(xiàng)(setupsubclasses...)
        添加刪除 Layer
        New Subclass..
        設(shè)定B/Bvia(setupViasDefine B/Bvia...)
        設(shè)定工具欄
        同其他工具,
        元件的基本操作
        元件的移動:(EditMoveOptions...)
        Ripup etch:移動時(shí)顯示飛線
        Stretch etch:移動時(shí)不顯示飛線
        元件的旋轉(zhuǎn):(EditSpinFindSymbol)
        元件的刪除:(EditDelete)
        信號線的基本操作:
        更改信號線的寬度(EditChangeFindClines)optionlinewidth
        刪除信號線(EditDelete)
        改變信號線的拐角(EditVertex)
        刪除信號線的拐角(EditDelete Vertex)
        顯示詳細(xì)信息:
        編輯窗口控制菜:
        常用元件屬性(Hard_Location/Fixed)
        常用信號線的屬性
        一般屬性:
        NO_RAT;去掉飛線
        長度屬性:propagation_delay
        等長屬性:relative_propagation+delay
        差分對屬性:differential pair
        設(shè)定元件屬性(EditProperities)
        元件加入Fixed屬性:(EditProperitiesfindcomps..)
        設(shè)置(刪除)信號線:Min_Line_width:(EditProperitiesfind ets)
        設(shè)定差分對屬性:setupElectrical constraint spread sheetNet outingdifferential pair

        本文引用地址:http://www.antipu.com.cn/article/190075.htm



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