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        基于FPGA的雙備份多路數(shù)據(jù)采集存儲系統(tǒng)的設計與實

        作者: 時間:2013-04-11 來源:網(wǎng)絡 收藏

        4 測試試驗

        對數(shù)據(jù)采集進行炮擊試驗,其目的是為了考核記錄器的外部結構以及內(nèi)部電路板的抗過載能力。試驗前,采編器采集標準的模擬彈上信源(正弦波、方波、直流量、鋸齒波……依次循環(huán)),并存入存儲器,然后將整個系統(tǒng)安裝在飛行體中,飛行體以極高的速度著靶,測試采集的沖擊過載能力。試驗后電路板正常無損壞,而其中一塊(B片)外部晶體振蕩器損壞,因此,存儲器采用雙時鐘源,正常情況下由晶體振蕩器提供時鐘源,在存儲器回收后讀取數(shù)據(jù)時,若晶體振蕩器損壞,可由地面測試臺提供的備用時鐘作為存儲器時鐘源,這樣就避免了回收存儲器后更換晶體振蕩器的麻煩。試驗完成后從A片存儲器中回收數(shù)據(jù),并與試驗前的數(shù)據(jù)相比較,結果一致,再從B片存儲器中回收數(shù)據(jù)(由于外部晶體振蕩器損壞,需用備用時鐘源),與試驗前的數(shù)據(jù)相比較,其波形一致,如圖8所示。圖8中列舉了其中4個通道T1~T4的電壓信號,試驗表明,該系統(tǒng)具有很強的抗過載能力。

        本文給出了基于雙存儲器的數(shù)據(jù)采集的電路設計和控制邏輯設計。在工程實踐的基礎上,對多通道異步時分電路的通道串擾現(xiàn)象提出了可行性的解決方案,同時詳細地介紹了采用實現(xiàn)采集控制邏輯以及存儲邏輯的方法,也給出了采集控制邏輯的流程和存儲邏輯的設計流程。通過飛行試驗,該采集存儲系統(tǒng)采集了用來評估飛行器的各種技術指標的有用數(shù)據(jù),實踐證明,雙設計有效的提高了數(shù)據(jù)回收的可靠性。


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