由數(shù)碼管顯示電路可以知道，這是共陽極數(shù)碼管。當(dāng)在位選端SE1～SE4輸入低電平時，三極管導(dǎo)通，從而D1～D4接入高電平。由a到DP端輸入數(shù)碼管顯示碼，就可以得到我們所需要的數(shù)字，由位選端讓數(shù)碼管選擇導(dǎo)通。

2 FPGA模塊設(shè)計
FPGA模塊的設(shè)計主要是實現(xiàn)將由光電編碼器轉(zhuǎn)換得到的電信號轉(zhuǎn)換成轉(zhuǎn)速值，通過數(shù)碼管顯示。因此本次設(shè)計的模塊主要有分頻模塊、計數(shù)模塊、鎖存模塊、數(shù)據(jù)處理模塊和動態(tài)顯示模塊等組成。
2．1 分頻模塊的設(shè)計
在本次設(shè)計中我們需要得到的是轉(zhuǎn)速值，而測量的根本原理就是將轉(zhuǎn)速信號轉(zhuǎn)換為頻率信號，同過測量頻率信號從而算出轉(zhuǎn)速值。由于外部時鐘提供的是50 MHz的時鐘信號，此信號送入FPGA模塊，通過程序?qū)⑵溥M行分頻，設(shè)計需要的是1 s的閘門脈沖，來統(tǒng)計被測信號的個數(shù)，從而計算出被測信號的頻率。
分頻模塊的設(shè)計流程圖如圖5所示。

2．2 四位十進制計數(shù)
四位十進制計數(shù)模塊是通過復(fù)位信號和閘門信號來控制模塊對外部被測信號的十進制計數(shù)。當(dāng)復(fù)位信號為高電平時，b1、b2、b3、b4四位計數(shù)信號都為0。當(dāng)復(fù)位信號為低電平，并且閘門信號為高電平時，計數(shù)模塊開始統(tǒng)計外部信號clk1的個數(shù)，b4為最高位，b1為最低位。