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	 > 模擬技術(shù) > 設(shè)計應(yīng)用 > 基于HyperLynx的高速PECL交流耦合時鐘
        
    
        

        

        


	
	
	

        
	
        
		
        
			
        基于HyperLynx的高速PECL交流耦合時鐘
        
						
        
				作者：
				時間：2010-01-27
				來源：網(wǎng)絡(luò)
				
				
				
				
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			2．2時鐘輸入結(jié)構(gòu) 
        本文引用地址：http://www.antipu.com.cn/article/188363.htm
        ADS5463的時鐘輸入特性如圖3所示。
        由圖3可看出時鐘的輸入幅度和共模電壓與ADC信噪比的關(guān)系，當(dāng)輸入時鐘為300 MHz時，只有峰峰值大于O．5 V、小于3．5 V，共模電壓大于1 V、小于3．5 V才有最佳的信噪比指標(biāo)，LVPECL電平的共模電壓為Vcc一1．3 V=3．3 V-1．3 V=2 V，典型峰峰值700 mV，剛好滿足ADS5463對時鐘的要求。ADS5463在時鐘輸入端由內(nèi)部電阻將時鐘輸人共模電壓偏置到2．4 V，這與發(fā)送端的共模電壓不同，故采用交流耦合是最好的方式。時鐘電路初步設(shè)計見圖4。
        如圖4所示，在ICS8530ll的每個輸出端都并聯(lián)了一個142 Ω的電阻到地，這個電阻的作用是：由于輸出共模電壓固定在Vcc一1．3 V=2 V，為了使輸出電流維持在14 mA，故直流偏置電阻值選擇2 V／14 mA=142 Ω，實(shí)際選取時可選擇140～200 Ω。此時雙端傳輸線特性阻抗為50 Ω。 
        3電路仿真
        下面打開HyperLynx，將上述電路導(dǎo)入其中的LineSim工具下，該工具是HyperLynx的一個子工具，主要用來進(jìn)行傳輸線的拓?fù)浣Y(jié)構(gòu)的仿真，可以對不同端接方式下的信號完整性進(jìn)行分析。LineSim中的傳輸線模型構(gòu)筑如圖5所示。
        
				
            
                
			
							
        
                
			            
                            
              
            
        
		
        
		
        
		
        
		
        
		
        
			
          
				
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        關(guān)鍵詞：
            			            HyperLynx
                        PECL
                        交流耦合
                        時鐘
                        
                        
            
        
            
			
        
		
        	
		

	

        
	
	
        
		
        
			
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