3.2 測(cè)試序列測(cè)試結(jié)果
　　對(duì)三種測(cè)試序列在總線頻率120MHz下進(jìn)行優(yōu)化前后幀率測(cè)試，結(jié)果如表2所示。從表2可以看出，采用以上優(yōu)化方法能顯著提高幀率。

3.3 不同數(shù)據(jù)總線頻率下測(cè)試結(jié)果
　　對(duì)于不同的總線頻率，優(yōu)化后編碼幀率不同，結(jié)果如表3所示，采用的測(cè)試序列為foreman。

　　本文介紹了H.264標(biāo)準(zhǔn)的框架，研究了X264軟件的實(shí)現(xiàn)方案，對(duì)ADSP-BF561處理器體系結(jié)構(gòu)進(jìn)行分析，提出了一套X264優(yōu)化方案，包括：算法替代和改進(jìn)、內(nèi)聯(lián)函數(shù)、匯編代碼編寫、高速存儲(chǔ)器應(yīng)用等。測(cè)試結(jié)果表明，優(yōu)化后的算法編碼效率有顯著提高，具有很強(qiáng)的實(shí)用價(jià)值。但是，本文主要從編碼速度和效率兩方面對(duì)編碼器進(jìn)行優(yōu)化，在復(fù)雜度和編碼質(zhì)量上仍需不斷對(duì)關(guān)鍵算法進(jìn)行分析整合，提出新的優(yōu)化算法。同時(shí)，編碼器的碼率控制尚未完善，如何在降低計(jì)算復(fù)雜度的前提下有效進(jìn)行碼率控制，需進(jìn)一步研究。

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