一種改進(jìn)型的時分多址的實現(xiàn)方法
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使用芯片內(nèi)部的雙口RAM的IP核，通過例化IP核，利用一個雙口RAM有兩套讀寫地址，將程序的輸入輸出與雙口RAM的輸入輸出進(jìn)行映射，則內(nèi)部電路將程序的輸入輸出連接到了雙口RAM的輸入輸出上。對程序的輸入輸出腳的操作相當(dāng)于對雙口RAM進(jìn)行操作。圖1是雙口RAM的VHDL代碼在Xilinx ISE中綜合后的寄存器傳輸級電路圖。
圖1 雙口RAM的寄存器傳輸級電路
在端口A輸入時鐘clk3072的每個下降沿，端口A輸入地址AddrIn都遞增1，則在elk3072的上升沿，根據(jù)例化的雙口RAM的IP核，端口A的四路輸入數(shù)據(jù)將存儲進(jìn)相應(yīng)的地址空間中。
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